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Measuring Treck TCP/IP Performance Using the XPS LocalLink TEMAC in an Embedded
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2012-05-11 18:28:48
Post-Configuration Access to SPI Flash Memory with Virtex-5 FPGAs
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2012-05-11 18:28:02
Spartan FPGA 低成本、高效率串行配置
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2012-05-11 18:27:07
配置混合式 FPGA 菊花链
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2012-05-11 18:26:19
FPGA 配置指南
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2012-05-11 18:24:48
使用 XC9500 CPLD 和并行 PROM 配置 Xilinx FPGA
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2012-05-11 18:24:00
Xilinx In-System Programming Using an Embedded Microcontroller
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2012-05-11 18:23:17
Programmable Development and Test(
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2012-05-11 18:20:28
Xilinx FPGA 的 System ACE 配置解决方案
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2012-05-11 18:19:30
7:1 Serialization in Spartan-3E/3A FPGAs at Speeds Up to 666 Mbps
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2012-05-09 20:03:47
Audio/Video Connectivity Solutions for Virtex-5 FPGAs
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2012-05-09 20:02:31
Reference Design: Logicore OPB USB 2.0 Device
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2012-05-09 19:55:39
1:7 Deserialization in Spartan-3E/3A FPGAs at Speeds Up to 666 Mbps
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2012-05-09 19:54:43
在数字视频应用中使用 CoolRunner-II CPLD
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2012-05-09 19:49:34
133 MHz PCI-X 到128 MB DDR 小型 DIMM 存储器桥
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2012-05-09 19:38:37
参考系统: OPB CAN 控制器
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2012-05-09 19:37:44
使用带 OMAP 的 CoolRunner-II , XScale, i.MX 和其他芯片
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2012-05-09 19:36:47
将 Spartan-3 FPGA 用作远程数码相机的低成本控制器
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2012-05-09 19:34:47
利用 CoolRunner-II CPLD 创建交叉点开关
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2012-05-09 19:27:17
使用 Spartan-II 的 Reed-Solomon 解决方案
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2012-05-09 19:22:41
使用 Spartan-II 中的 DES/三重 DES 功能进行数据加密
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2012-05-09 19:21:32
Virtex-5 FPGA Interface to a JESD204A Compliant ADC
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2012-05-09 19:15:24
SerDes Channel Simulation in FPGAs Using IBIS-AMI
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2012-05-09 19:10:37
利用 CoolRunner CPLD 实现无线收发器
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2012-05-09 19:08:57
手机/终端内的 CoolRunner-II CPLD
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移动 SDRAM 与 CoolRunner-II CPLD 接口
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2012-05-09 19:07:19
FPGA 中的 DSP 协处理:嵌入高性能、低功耗的 DSP 功能
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使用 SRL 宏实现 PN 生成器
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2012-05-09 19:04:42
ML310 上的 PPC405 步锁系统 (Lockstep System)(
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2012-05-09 19:02:48
Designing Wireless Digital Up/Down Converters Leveraging CORE Generator/System G
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2012-05-09 19:00:56
Designing Efficient Digital Up and Down Converters for Narrowband Systems
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2012-05-09 18:59:11
Connecting Virtex-6 FPGAs to ADCs with Serial LVDS Interfaces and DACs with Para
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A 3/4/5/6X Oversampling Circuit for 200 Mb/s to 1000 Mb/s Serial Interfaces
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2012-05-09 18:50:02
Dynamically Programmable DRU for High-Speed Serial I/O
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数字锁相环 (DPLL) 参考设计
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参考系统:OPB 以太网 MAC
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参考系统:PLB 三态以太网 MAC
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2012-05-09 18:34:51
10 Gigabit Ethernet/Fibre Channel PCS Reference Design - Not Recommended for New
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Connecting Xilinx FPGAs to the Philips A-rate Fibre Optic Transceiver - Not Reco
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Configurable Physical Coding Sublayer - Not Recommended for New Designs
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