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FPGA设计中，对SPI进行参数化结构设计 【FPGA/CPLD】

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简谈FPGA设计中不同设计方法资源消耗对比 【FPGA/CPLD】

地弹噪声对信号完整性的影响

字符串核对匹配居然还能这样写，真是万能的指针。

对IP设计中注意事项及FPGA原型设计进行说明

如何最大程度地降低地弹噪声对单板信号完整性影响

从仿真器的角度对Verilog语言的语法规则进行解读

CPLD国产替代的成熟选择选型对标

对FIR数字滤波器的FPGA实现的研究

SoC设计中的IP软核与硬核的对比及方案选择

如何使用FPGA对系统设计实现有效管理

[精华] FPGA的时钟质量对设计的影响 【FPGA/CPLD】

可编程逻辑器件和ASIC对比介绍

献给初学者－DSP入门教程2 【DSP系统】

对于FPGA“可编程”的几大准则

一篇对DSP初学者很有用的文章（转） 【DSP系统】

FPGA越来越精密，对DC-DC电源的精度也越来越高 【FPGA/CPLD】

别搞错了！FPGA的对手不是ASIC

GPU、FPGA、ASIC等主流AI芯片对比 【FPGA/CPLD】

一个牛人对FPGA的理解－－太可怕了！

sitime可编程晶振尺寸对应图 【FPGA/CPLD】

面对新冠肺炎，FPGA能为我们做些什么

面对大烧录量和严格性能要求，如何高效快速生产汽车零组件

FPGA相对于ASIC 具有以下这些优势

TensorFlow通过优化的开源SYCL™库获得对PowerVR GPU的原生支持

如何通过4G智能网关对PLC进行远程控制

FPGA对IDE硬盘读写问题几点疑惑 [求助] 【FPGA/CPLD】

九种编程语言大对比 【FPGA/CPLD】

时钟频率对程序效率影响测试(Platform: ARM ZYNQ 7000 ZP20 Board) 【FPGA/CPLD】

如何用fpga或者其他器件对方波脉冲信号产生无任何时间抖动的延时？ 【FPGA/CPLD】

嵌入式系统的发展对半导体器件的影响 【FPGA/CPLD】

我想在linux下对绝对地址进行读写访问出现问题 【FPGA/CPLD】

绝对值编码器 【FPGA/CPLD】

想问大神dsp程序对dat文件的使用问题 【DSP系统】

向各位请教一下，谁知道哪里有可以对AT25DF081进行读写操作的最最便宜的编程器呀，谢谢了。 【FPGA/CPLD】

给大家分享一个福利，Robei软件对学生免费发放了！ 【FPGA/CPLD】

在多个always语句中对同一个变量进行赋值，结果无法综合。求教该怎么修改 【FPGA/CPLD】

时钟上升沿下降沿同时采样仿真数据不对，求大神解救 【FPGA/CPLD】

对于C5000，大于48K的程序如何BOOT的解决方法 【DSP系统】