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[置顶] NXP原厂样品1元秒杀了，云汉芯城新用户快来申请！ nakey\|浏览：11741\|回复：3\| 帅521520 2025-07-09 14:43:28
[置顶] 打赏了！打赏了！打赏了！ lantu\|浏览：147361\|回复：45\| 丙丁先生1 2025-06-15 09:36:46
[置顶] EEPW会员技术专刊《电子设计与芯片应用》纸质版免费索阅在这里 lantu\|浏览：157483\|回复：21\| 丙丁先生1 2025-03-22 12:35:29
我安装quartus II，出现这个，怎么回事啊？【FPGA/CPLD】站的高尿的远\|浏览：1733\|回复：0\| 站的高尿的远 2015-04-20 16:26:29
contex r4的平台上做spi nor flash的烧写问题【FPGA/CPLD】站的高尿的远\|浏览：1783\|回复：0\| 站的高尿的远 2015-04-15 13:47:52
请教一下大家，MATLAB调用SIgnal Tap 2出现如上错误是怎么回事？该如何解决？谢谢【FPGA/CPLD】站的高尿的远\|浏览：1871\|回复：0\| 站的高尿的远 2015-04-15 10:20:14
请问大学生电子设计大赛中有哪些题目适合用FPGA来做呢？【FPGA/CPLD】 KingsleyChu\|浏览：5079\|回复：0\| KingsleyChu 2015-04-14 20:54:09
CCS5.5 关于IQmathLib 【DSP系统】白骨之舞\|浏览：2801\|回复：1\| paradoxfx 2015-04-14 19:24:42
个dds产正弦信号问题【FPGA/CPLD】站的高尿的远\|浏览：1680\|回复：1\| jackwang 2015-04-14 16:01:20
电脑怎么接收USB芯片68013的数据？【FPGA/CPLD】站的高尿的远\|浏览：2017\|回复：2\| jackwang 2015-04-13 14:38:04
有谁烧写过TMS320C54x系列的DSP 【DSP系统】站的高尿的远\|浏览：2492\|回复：2\| zwl773993221 2015-04-09 18:40:12
FPGA是什么？FPGA现状？怎样学习FPGA？【FPGA/CPLD】 zxopen00\|浏览：4255\|回复：8\| fpgachuxue 2015-04-07 10:33:08
signal tap 【FPGA/CPLD】学习一下\|浏览：2492\|回复：3\| fpgachuxue 2015-04-07 10:31:39
xilinx开发有一个读音像iselise的东西吗？【FPGA/CPLD】 lhzh7\|浏览：1984\|回复：0\| lhzh7 2015-04-05 13:42:14
quartus编译后显示占用占用资源为0，请问为什么出现这种情况【FPGA/CPLD】站的高尿的远\|浏览：4562\|回复：2\| jackwang 2015-04-03 10:05:35
ROM中存入32个8位数据，我写了读程序我怎么看到我读的数据了【FPGA/CPLD】 duxvfeng\|浏览：3316\|回复：2\| duxvfeng 2015-04-01 16:47:48
论述基于MCU和DSP的步进电机控制技术【DSP系统】 dianzi88\|浏览：2126\|回复：1\| w75815895 2015-04-01 16:43:34
请教一个SDRAM问题【FPGA/CPLD】站的高尿的远\|浏览：1567\|回复：0\| 站的高尿的远 2015-04-01 10:43:06
请大家帮我看一下，为什么我用DMA读出来的数据有时候会发生错误（共读3M的数据）【FPGA/CPLD】站的高尿的远\|浏览：1507\|回复：0\| 站的高尿的远 2015-04-01 10:42:42
请问下，我做了个简单的带UART的系统，然后进行DEBUG，串口没有输出，可能是什么原因啊【FPGA/CPLD】站的高尿的远\|浏览：2076\|回复：0\| 站的高尿的远 2015-03-25 16:15:21
IO配置【FPGA/CPLD】 yelo168\|浏览：1707\|回复：1\| yelo168 2015-03-23 22:43:56
这代码哪里错了【FPGA/CPLD】站的高尿的远\|浏览：1697\|回复：1\| 花涛 2015-03-23 15:17:41
求问下modelsim报这个错什么意思【FPGA/CPLD】站的高尿的远\|浏览：1853\|回复：1\| wjf19911004 2015-03-23 08:38:48
【应用笔记】AN 479:在Cyclone系列器件中实现LVDS接口设计指南(AN 479: Design Guidelines for Implementin 【FPGA/CPLD】 bobgeng\|浏览：3090\|回复：1\| zcgeek 2015-03-22 21:04:22
时钟上升沿下降沿同时采样仿真数据不对，求大神解救【FPGA/CPLD】火焰昌\|浏览：2891\|回复：1\| zcgeek 2015-03-22 20:39:38
Vivado 2014.4 破解【FPGA/CPLD】 149030024\|浏览：2808\|回复：0\| 149030024 2015-03-19 12:51:28
RE:AFE5805芯片配置【FPGA/CPLD】 zcgeek\|浏览：1637\|回复：0\| zcgeek 2015-03-19 09:40:58
请问各位，FIFO读写的时候，读写地址是根据什么产生的？【FPGA/CPLD】站的高尿的远\|浏览：1600\|回复：1\| jackwang 2015-03-18 10:22:20
DSP自动加载过程及程序烧写的简化设计【DSP系统】 putianyaoxie\|浏览：3071\|回复：1\| paradoxfx 2015-03-17 21:04:19
VC上位机MFC利用串口控件发送接收数据【FPGA/CPLD】南盗\|浏览：7722\|回复：9\| 风魔小象 2015-03-16 20:20:07
求推荐开关电源设计方面的资料【DSP系统】落月风情\|浏览：2033\|回复：1\| 无我时代 2015-03-14 13:57:38
基于DSP仿人机器人关节控制器电路设计【DSP系统】 putianyaoxie\|浏览：2160\|回复：0\| putianyaoxie 2015-03-13 14:20:23
PLL模块使用中的一些错误（转）【FPGA/CPLD】风魔小象\|浏览：2672\|回复：0\| 风魔小象 2015-03-12 19:25:17
jatg下载不了问题求助。白菜一枚~~ 【FPGA/CPLD】阿PFGA\|浏览：2301\|回复：4\| 阿PFGA 2015-03-11 16:30:52
Xilinx_ISE_Design_Suite_v10_1___CRSiSO 【FPGA/CPLD】九哥\|浏览：2444\|回复：2\| 风魔小象 2015-03-09 19:59:59
3.3V的FPGA，我给他接进去的信号峰峰值到3.4V多点，有危险吗？【FPGA/CPLD】站的高尿的远\|浏览：2258\|回复：1\| 风魔小象 2015-03-09 19:56:43
VHDL INOUT 信号仿真【FPGA/CPLD】火焰昌\|浏览：1624\|回复：0\| 火焰昌 2015-03-06 21:37:15
这个报错是什么原因啊？【FPGA/CPLD】站的高尿的远\|浏览：1245\|回复：0\| 站的高尿的远 2015-03-05 16:14:15
一种面向LTE基站的SOC平台软件解决方案【DSP系统】 putianyaoxie\|浏览：2302\|回复：0\| putianyaoxie 2015-03-04 11:51:26
Altera的FPGA内置的乘法器为何是18位的？【FPGA/CPLD】寒月迷亭\|浏览：2389\|回复：2\| 寒月迷亭 2015-03-02 14:38:19
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请教一个Verilog HDL 语法问题【FPGA/CPLD】 lianxiuxiu\|浏览：2099\|回复：1\| jiahua1010 2015-02-16 15:30:32

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