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工程师
2019-07-07 09:54:24    评分
531楼

前处于建模期,不过已经完成80%,软件用的是NX10.0,不多说了,先看看样子,给点建议哈~


工程师
2019-07-08 09:23:10    评分
532楼

中间打坏了一次、、、这个终于成了、、、


工程师
2019-07-09 09:14:53    评分
533楼

打坏了一次、、、这个终于成了、


工程师
2019-07-10 09:04:43    评分
534楼

、这个终于成了


高工
2019-07-10 10:43:37    评分
535楼

牛帖啊


工程师
2019-07-11 14:31:33    评分
536楼
zynq-ax7010开发板按照提供的开发板资料,使用默认配置完成移植后,启动时提示:I2C EEPROM MACaddress read failed,排除24LC04芯片问题,应该与zynq ps芯片或uboot代码配置有关。
对比xilinx官方提供的uboot:https://github.com/Xilinx/u-boot-xlnx/发现uboot(u-boot-xlnx-xilinx-v2017.1.tar.gz文件)中\board\xilinx\zynq\board.c所有改动,
错误打印也是来自此文件:zynq_board_read_rom_ethaddr函数,网上搜索有看到同样的错误打印。
请问各位大神有什么解决方法,多谢留言!



工程师
2019-07-12 08:54:47    评分
537楼

基于FPGA的图像拉普拉斯边缘提取

AT7_Xilinx开发板USB3.0+LVDS)资料共享       腾讯链接:https://share.weiyun.com/5GQyKKc       百度网盘链接:https://pan.baidu.com/s/1M7PLzRs-yMJv7NFJE8GVAw       提取码:qr0t                              1系统概述如图所示,这是整个视频采集系统的原理框图。上电初始,FPGA需要通过IIC接口对CMOS Sensor进行寄存器初始化配置。这些初始化的基本参数,即初始化地址对应的初始化数据都存储在一个预先配置好的FPGA片内ROM中。在初始化配置完成后,CMOS Sensor就能够持续输出标准RGB的视频数据流,FPGA通过对其同步信号,如时钟、行频和场频进行检测,从而从数据总线上实时的采集图像数据。MT9V034摄像头默认初始化数据就能输出正常的视频流,因此FPGA中实际上未作任何IIC初始化配置。在FPGA内部,采集到的视频数据先通过一个FIFO,将原本25MHz频率下同步的数据流转换到50MHz的频率下。接着将这个数据再送入写DDR3缓存的异步FIFO中,这个FIFO中的数据一旦达到一定数量,就会写入DDR3中。与此同时,读取DDR3中缓存的图像数据,缓存到FIFO中,并最终送往LCD驱动模块进行显示。LCD驱动模块不断的发出读图像数据的请求,并驱动液晶显示器显示视频图像。本实例除了前面提到对原始图像做DDR3缓存和显示,还会在原始图像缓存到DDR3之前,另外做图像的多行缓存和拉普拉斯边缘提取处理,获得新的图像流,这个图像流写入到DDR3中。根据LCD显示模块的请求,读取DDR3中处理后的图像进行显示。最终在VGA液晶显示器上,可以看到左侧图像是原始的图像,右侧图像是经过边缘提取处理后的图像。



工程师
2019-07-12 08:55:09    评分
538楼

坏了一次、、、这个终于成了


工程师
2019-07-13 14:31:30    评分
539楼

一次、、、这个终于成了、


工程师
2019-07-14 12:21:02    评分
540楼

坏了一次、、、这个终于成


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