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软件与操作系统  -  规则

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ALLEGRO 约束规则设置步骤（以DDR 为例） 【EDA工具】
angelazhang|浏览：2485|回复：8| 同煮山川 2022-06-18 23:40:23
高频PCB板布线规则经验分享 【EDA工具】
angelazhang|浏览：2392|回复：10| jwdxu2009 2022-06-15 10:44:35
cadence16.5基本规则设置 【EDA工具】
angelazhang|浏览：2060|回复：5| wzj9944 2022-06-12 00:19:00
分享关于ddr3的走线及绕线规则 【EDA工具】
angelazhang|浏览：5109|回复：17| jwdxu2009 2022-06-10 12:59:45
DDR3 PADS布线视频教程-布局规则篇 【EDA工具】
angelazhang|浏览：22576|回复：108| 13554437816 2022-06-10 11:40:57
总结的《Allegro中的约束规则设置》线宽、间距、等长…… 【EDA工具】
angelazhang|浏览：8320|回复：37| gaon 2021-12-08 17:33:33
献给新手或纠结于文档混乱的老弟们 命名规则表（allegro焊盘命名规则） 【EDA工具】
angelazhang|浏览：2616|回复：7| 028lhc 2020-08-18 01:07:48
Allegro16.6约束规则设置详解 【EDA工具】
angelazhang|浏览：2893|回复：9| 池和瓢 2019-01-15 09:12:52
富士康ALLEGRO封装命名规则 【EDA工具】
angelazhang|浏览：6499|回复：29| yinwei1234 2018-12-27 09:23:51
分享DDR2-800和DDR3的布线规则 【EDA工具】
angelazhang|浏览：3727|回复：11| sun12345 2018-12-19 11:58:19
cadence16.x约束规则设置 【EDA工具】
angelazhang|浏览：1958|回复：1| 完美胜丰 2017-05-06 00:44:22
ALLEGRO 约束规则设置步骤（以DDR 为例） 【EDA工具】
angelazhang|浏览：1688|回复：3| 完美胜丰 2017-05-05 22:21:14
AD_drc规则中英对照 【EDA工具】
明天会更好呀|浏览：2386|回复：5| 我的1992 2017-04-07 17:19:30
Altium Designer BGA扇出，原理图中PCB的类和布线规则设置 【EDA工具】
angelazhang|浏览：26331|回复：0| angelazhang 2015-05-04 21:31:52
Android Market排名算法及规则 【操作系统】
fellow|浏览：1831|回复：0| fellow 2013-09-02 16:16:01
DesignSpark PCB全新版本第五版发布!（在线设计规则检测，以及总线设计） 【EDA工具】
DesignSparkCN|浏览：3292|回复：5| panminghui 2013-05-15 08:41:57
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