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FPGA  -  锁相环

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FPGA零基础学习之Vivado-锁相环使用教程 【FPGA/CPLD】
FPGA江湖|浏览：727|回复：2| MarsZ 2023-08-17 17:21:46
带宽自适应全数字锁相环的设计与实现
Dummer3|浏览：541|回复：0| Dummer3 2021-07-09 23:53:38
FPGA100天之旅锁相环 【FPGA/CPLD】
zxopenljx|浏览：2597|回复：4| 清歌孤我 2020-10-20 22:51:05
600MHz高性能可编程锁相环设计与分析.zip 【FPGA/CPLD】
zxopenljx|浏览：3060|回复：3| zxopenljx 2020-10-12 17:21:36
基于ADSP-BF531处理器的时钟及锁相环
船长demons|浏览：530|回复：0| 船长demons 2020-09-21 23:45:03
基于FPGA数字锁相环 【FPGA/CPLD】
zxopenljx|浏览：2548|回复：2| zxopenljx 2020-07-31 10:25:18
基于可编程逻辑芯片和CPU实现数字锁相环频率合成器的设计
清歌孤我|浏览：766|回复：0| 清歌孤我 2020-07-30 23:11:17
基于FPGA 的逆变器全数字锁相环设计 【FPGA/CPLD】
glorey|浏览：7597|回复：2| zxopenljx 2020-07-14 21:00:42
基于FPGA器件和CPU控制实现数字锁相环频率合成系统的设计
同煮山川|浏览：766|回复：4| zxopenljx 2020-05-23 14:05:40
基于FPGA的锁相环位同步提取电路设计 【FPGA/CPLD】
xiaogun|浏览：2281|回复：2| twieain 2014-08-02 10:26:45
基于FPGA可编程的全数字锁相环路的实现 【FPGA/CPLD】
dianzi88|浏览：2143|回复：1| htbadboy 2014-07-31 15:48:09
深刻理解数字锁相环 【FPGA/CPLD】
叮叮当当|浏览：5086|回复：3| 夜空守望者 2014-07-31 12:17:06
【用户指南】Altera锁相环(ALTERA_PLL)宏功能模块用户指南(Altera Phase-Locked Loop (ALTERA_PLL) Megaf 【FPGA/CPLD】
bobgeng|浏览：3242|回复：1| zhq2003 2013-06-27 13:31:03
【应用笔记】高性能FPGA锁相环的TimeQuest时序分析(High-Performance FPGA PLL Analysis with TimeQuest 【FPGA/CPLD】
bobgeng|浏览：1957|回复：0| bobgeng 2012-05-16 16:00:59
modelsim如何仿真q2生成的锁相环 【FPGA/CPLD】
becoll|浏览：8049|回复：13| hollytoday1 2010-07-18 20:47:02
数字锁相环设计源程序 【FPGA/CPLD】
叮叮当当|浏览：2229|回复：0| 叮叮当当 2008-01-05 00:36:40
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