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程序不稳定的问题,请教! [

助工
2013-05-13 14:00:09    评分
写的一个Verilog程序,代码稍微动一下,实现的功能不变,比如1.一个逻辑与由子模块从挪出放到主程序里,其中的一部分管脚输出就变了,再如2.将一些注释之类的去掉,逻辑运算符等运算符的两侧留的空格去掉,重新编译结果又变了,是啥原因呢?



关键词: 程序     不稳     定的     问题     请教    

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