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[置顶] 这个春节你犒赏自己什么了？分享你的故事，有奖征集咔嚓猫爱刺鱼\|浏览：11974\|回复：14\| leihaozhuce 2026-03-04 23:18:27
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[置顶] 打赏了！打赏了！打赏了！ lantu\|浏览：205520\|回复：46\| jwdxu2009 2026-02-07 09:00:31
[置顶] EEPW会员技术专刊《电子设计与芯片应用》纸质版免费索阅在这里 lantu\|浏览：228080\|回复：23\| jj1230 2025-12-03 18:31:42
【重要更新】Quartus II 14.1正式版下载链接和破解器【FPGA/CPLD】约瑟叔叔\|浏览：20608\|回复：11\| taksonwelson 2016-01-14 10:40:20
哪如果要时序仿真得自己另外下载modesim做么？【FPGA/CPLD】站的高尿的远\|浏览：1943\|回复：2\| taksonwelson 2016-01-14 10:39:33
什么是FMC 【FPGA/CPLD】乌卡卡\|浏览：2921\|回复：4\| taksonwelson 2016-01-14 10:39:08
请问各位，串口通信中波特率发生模块计数器设置，若为9600传输速率是不是设置成系统时钟/9600*2 呢？【FPGA/CPLD】站的高尿的远\|浏览：3004\|回复：5\| taksonwelson 2016-01-14 10:38:48
输入信号经过64个时钟延迟，再与输入数据进行叠加【FPGA/CPLD】钟离紫星\|浏览：2812\|回复：3\| taksonwelson 2016-01-14 10:38:07
MODELSIM仿真提示already declared in this scope 【FPGA/CPLD】 duxvfeng\|浏览：5205\|回复：3\| taksonwelson 2016-01-14 10:35:46
一个近一年了都没人来帮助解答的问题【FPGA/CPLD】站的高尿的远\|浏览：2268\|回复：4\| taksonwelson 2016-01-14 10:33:08
初学CPLD，请教！【FPGA/CPLD】站的高尿的远\|浏览：3009\|回复：3\| taksonwelson 2016-01-14 10:31:25
DIY自己的DM642EVM 【DSP系统】 zhuzai\|浏览：2002\|回复：1\| gongquan56 2016-01-11 10:00:02
如何学习DSP 【DSP系统】 wangjinquan\|浏览：1747\|回复：1\| jackwang 2016-01-08 15:37:39
28335读AD7606，发现AD7606的地址不固定【DSP系统】 77143168\|浏览：1770\|回复：0\| 77143168 2016-01-05 15:20:50
5509A程序运行时断开与仿真器连接【DSP系统】陌上花开olo\|浏览：2212\|回复：0\| 陌上花开olo 2016-01-02 16:54:22
开发板屏幕问题【FPGA/CPLD】笑花\|浏览：2723\|回复：6\| jobs 2015-12-28 20:16:32
求助如何理解这句SyncClk 【FPGA/CPLD】暗夜涌袭\|浏览：2763\|回复：2\| tokeyman 2015-12-17 22:44:30
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用synplify综合Xilinx的core后为什么在Technology view中看不到相应的模块？【FPGA/CPLD】 becoll\|浏览：10335\|回复：4\| lulu08171537 2015-12-17 18:26:03
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《FPGA攻略之Testbench篇》--仿真之不二法门，教你写Testbench！【FPGA/CPLD】 zhuwei0710\|浏览：7158\|回复：17\| 871016785 2015-11-25 20:44:14
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