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[置顶] 【福利征集】工程师工作台缺失好物！回帖给我，帮你实现！ EEPW\|浏览：56122\|回复：50\| leihaozhuce 2026-06-16 18:35:26
[置顶] 功能安全，不只是标准问题，更是系统问题 EEPW\|浏览：21394\|回复：2\| andeyqi 2026-05-07 09:19:07
[置顶] EEPW新年祝福 lantu\|浏览：49190\|回复：26\| flyway 2026-03-18 15:55:21
[置顶] 打赏了！打赏了！打赏了！ lantu\|浏览：230015\|回复：46\| jwdxu2009 2026-02-07 09:00:31
[置顶] EEPW会员技术专刊《电子设计与芯片应用》纸质版免费索阅在这里 lantu\|浏览：252889\|回复：23\| jj1230 2025-12-03 18:31:42
3.3V的FPGA，我给他接进去的信号峰峰值到3.4V多点，有危险吗？【FPGA/CPLD】站的高尿的远\|浏览：2427\|回复：1\| 风魔小象 2015-03-09 19:56:43
VHDL INOUT 信号仿真【FPGA/CPLD】火焰昌\|浏览：1792\|回复：0\| 火焰昌 2015-03-06 21:37:15
这个报错是什么原因啊？【FPGA/CPLD】站的高尿的远\|浏览：1387\|回复：0\| 站的高尿的远 2015-03-05 16:14:15
一种面向LTE基站的SOC平台软件解决方案【DSP系统】 putianyaoxie\|浏览：2660\|回复：0\| putianyaoxie 2015-03-04 11:51:26
Altera的FPGA内置的乘法器为何是18位的？【FPGA/CPLD】寒月迷亭\|浏览：2691\|回复：2\| 寒月迷亭 2015-03-02 14:38:19
学习FPGA需要的5项基本功【FPGA/CPLD】 xhxyd\|浏览：11\|回复：0\| xhxyd 2015-02-27 15:33:04
给各位网友拜个早年【DSP系统】 paradoxfx\|浏览：3468\|回复：6\| xqh518 2015-02-20 23:16:32
请教一个Verilog HDL 语法问题【FPGA/CPLD】 lianxiuxiu\|浏览：2440\|回复：1\| jiahua1010 2015-02-16 15:30:32
请教—多输入门的输出不可能是高阻态，怎么解释【FPGA/CPLD】 lianxiuxiu\|浏览：3915\|回复：3\| lianxiuxiu 2015-02-10 22:52:01
哪位好心人能告诉我这段是什么意思？【FPGA/CPLD】站的高尿的远\|浏览：2025\|回复：1\| lianggui5 2015-02-06 10:49:17
FPGA权威指南【FPGA/CPLD】青城山下\|浏览：2513\|回复：3\| weihuahua123 2015-02-04 14:31:19
求助-----S6D04H0驱动的LCD显示问题【FPGA/CPLD】 hxing\|浏览：2567\|回复：0\| hxing 2015-01-30 23:17:13
数字IC设计工程师笔试面试经典100题(大部分有答案) 【FPGA/CPLD】 putianyaoxie\|浏览：2667\|回复：2\| 冰语晨星 2015-01-30 09:05:36
求助大神，sift在FPGA上如何实现【FPGA/CPLD】小璐璐1211\|浏览：2762\|回复：4\| 小璐璐1211 2015-01-29 09:31:40
新的一年，一起学习【DSP系统】 scottly1\|浏览：3564\|回复：3\| 落月风情 2015-01-28 23:12:41
5409的McBSP配置成SPI口的小结【DSP系统】 zhuzai\|浏览：2912\|回复：1\| 落月风情 2015-01-28 23:10:22
[经验分享] 做DSP开发最应当懂的34个问题【DSP系统】 putianyaoxie\|浏览：5671\|回复：1\| zhaoying818 2015-01-28 22:27:17
请教个 FPGA综合信号被优化的问题。【FPGA/CPLD】 koanzhongxue\|浏览：2266\|回复：1\| koanzhongxue 2015-01-26 12:21:27
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我的问题：怎么选择 Export 列的属性为*_external connection？【FPGA/CPLD】站的高尿的远\|浏览：1846\|回复：1\| 风魔小象 2015-01-23 22:26:07
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