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Altera系列可编程逻辑器材的构造和原理南望\|浏览：1084\|回复：0\| 南望 2020-06-23 22:55:38
解决初学者疑惑：VHDL、Verilog，System+verilog比较 junxiu6\|浏览：4575\|回复：4\| zxopenljx 2020-06-23 09:55:32
led_water_tb(testbench文件) ljj16898083\|浏览：2272\|回复：1\| zxopenljx 2020-06-16 10:17:46
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Altera可重配置PLL使用手册（分享） Jason_Zhang\|浏览：44485\|回复：130\| miqi 2020-05-20 16:54:17
分享一款支持XilinxKintex-7FPGA开发板接口的32位DDR4SDRAM 英尚微电子\|浏览：1559\|回复：0\| 英尚微电子 2020-05-19 15:38:34
请问Xilinx SDK中与FPGA连接后 Terminal Settings 中，Port 应该是什么啊？站的高尿的远\|浏览：3758\|回复：1\| ygpygp1234 2020-05-15 13:57:12
关于Altera的fft核编译过程中的问题 bajuntu\|浏览：1123\|回复：1\| 卢风 2020-05-02 23:42:28
Altera DE2资料下载 Jason_Zhang\|浏览：19567\|回复：60\| zxopenljx 2020-04-18 14:48:44
Altera FPGA、CPLD 设计学习笔记（z） donnafan\|浏览：4018\|回复：4\| zxopenljx 2020-04-12 14:59:37
Altera FPGA/CPLD设计(高级篇) 叮叮当当\|浏览：14157\|回复：35\| zxopenljx 2020-04-12 14:56:10
[精华] AlteraFPGA硬核浮点DSP模块解决方案提高运算性能船长demons\|浏览：1777\|回复：4\| zxopenljx 2020-04-02 18:03:36
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基于可重构Virtex FPGA的天基系统同煮山川\|浏览：998\|回复：1\| 无厘头 2019-10-06 22:10:55
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【应用笔记】Cyclone II器件和DDR及DDR2 SDRAM的接口(Interfacing DDR & DDR2 SDRAM with Cyclone I bobgeng\|浏览：2650\|回复：1\| dengtuandy 2019-05-14 21:24:12
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