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Veritak Verilog-HDL 模拟器 ---- 市场最低价格的FPGA设计解决方案 【FPGA/CPLD】
my1edw|浏览：4769|回复：1| 2007-01-18 01:21:00
哪位大侠有verilog的好的参考书 【FPGA/CPLD】
yance|浏览：3487|回复：2| 2006-12-28 18:55:00
高速Verilog模拟器---Veritak 模拟器的下载 【FPGA/CPLD】
my1edw|浏览：3709|回复：1| 2006-04-12 03:00:00
multilevel V.S.multidimension 【FPGA/CPLD】
fanghlin|浏览：2841|回复：0| 2005-09-23 15:22:00
Active-HDL 4.2最新版（Cracked） 【FPGA/CPLD】
fanghlin|浏览：3934|回复：0| 2005-08-24 20:36:00
[请教]关于verilog中的任务 【FPGA/CPLD】
panzhijian|浏览：2722|回复：0| 2005-07-11 18:39:06
求助:verilog时钟求助 【FPGA/CPLD】
yigao|浏览：3017|回复：0| 2004-11-12 04:51:48
[求助]请问各位大侠，如何对Active中的Rom进行初始化？ 【FPGA/CPLD】
hqwqz|浏览：4101|回复：0| 2004-07-27 20:36:49
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