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请问各位,串口通信中波特率发生模块计数器设置,若为9600传输速率 是不是设置成 系统时钟/9600*2 呢?
【FPGA/CPLD】
站的高尿的远
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浏览:2662
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taksonwelson
2016-01-14 10:38:48
PCI通信速率问题
【DSP系统】
lidonglei1
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jobs
2013-02-17 21:46:20
【白皮书】在广播应用中实现多速率未压缩视频接口
【FPGA/CPLD】
bobgeng
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bobgeng
2012-04-20 21:05:16
【应用手册】Stratix IV GX 器件的RapidIO 动态数据速率重配置参考设计
【FPGA/CPLD】
bobgeng
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浏览:2503
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bobgeng
2012-04-06 22:45:49
大型设计中FPGA的多时钟设计策略
【FPGA/CPLD】
Jason_Zhang
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huangming1985
2010-04-18 18:55:39
高效FPGA乘法器在无线基站中的使用
【FPGA/CPLD】
老菜鸟
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浏览:2908
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老菜鸟
2008-04-10 17:18:49
飞思卡尔四内核DSP性能相当于2GHz单核处理器
【DSP系统】
madet
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浏览:2474
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2005-10-22 06:05:47
请教关于6711写速率问题
【DSP系统】
alien237
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浏览:2496
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2004-11-21 00:26:53
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