自己编写的一个小程序，功能是：时钟信号CLK1使数加1，CLK2使数减1，最后设置好的这个数要和一个给定的数进行大小比较。
可编译时报错，实在不知道怎么改：
Error: Can't resolve multiple constant drivers for net "D_OUT[7]" at zdz.vhd(15)
共6条
1/1 1 跳转至页
LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;
USE IEEE.STD_LOGIC_UNSIGNED.ALL;
ENTITY zdz IS
PORT(CLK1:IN STD_LOGIC; --加1单脉冲
CLK2:IN STD_LOGIC; --减1单脉冲
RST:IN STD_LOGIC;
DA :OUT STD_LOGIC; --LED指示信号
DATA:OUT STD_LOGIC_VECTOR(7 DOWNTO 0));
END zdz;
ARCHITECTURE behav OF zdz IS
SIGNAL D_IN : STD_LOGIC_VECTOR(7 DOWNTO 0);
SIGNAL D_OUT: STD_LOGIC_VECTOR(7 DOWNTO 0);
BEGIN
P1:PROCESS(CLK1,RST)
BEGIN
IF RST='1' THEN D_OUT<="10001000";
ELSIF CLK1'EVENT AND CLK1='1' THEN
D_OUT<=D_OUT+1;
END IF;
END PROCESS P1;
P2:PROCESS(CLK2,RST)
BEGIN
IF RST='1' THEN D_OUT<="10001000";
ELSIF CLK2'EVENT AND CLK2='1' THEN
D_OUT<=D_OUT-1;
END IF;
END PROCESS P2;
-----------------------------------------
DATA<=D_OUT;
D_IN<="10101010";
P3:PROCESS(D_OUT)
BEGIN
IF D_OUT > D_IN THEN DA<='1';
ELSE DA<='0';
END IF;
END PROCESS P3;
END behav;
USE IEEE.STD_LOGIC_1164.ALL;
USE IEEE.STD_LOGIC_UNSIGNED.ALL;
ENTITY zdz IS
PORT(CLK1:IN STD_LOGIC; --加1单脉冲
CLK2:IN STD_LOGIC; --减1单脉冲
RST:IN STD_LOGIC;
DA :OUT STD_LOGIC; --LED指示信号
DATA:OUT STD_LOGIC_VECTOR(7 DOWNTO 0));
END zdz;
ARCHITECTURE behav OF zdz IS
SIGNAL D_IN : STD_LOGIC_VECTOR(7 DOWNTO 0);
SIGNAL D_OUT: STD_LOGIC_VECTOR(7 DOWNTO 0);
BEGIN
P1:PROCESS(CLK1,RST)
BEGIN
IF RST='1' THEN D_OUT<="10001000";
ELSIF CLK1'EVENT AND CLK1='1' THEN
D_OUT<=D_OUT+1;
END IF;
END PROCESS P1;
P2:PROCESS(CLK2,RST)
BEGIN
IF RST='1' THEN D_OUT<="10001000";
ELSIF CLK2'EVENT AND CLK2='1' THEN
D_OUT<=D_OUT-1;
END IF;
END PROCESS P2;
-----------------------------------------
DATA<=D_OUT;
D_IN<="10101010";
P3:PROCESS(D_OUT)
BEGIN
IF D_OUT > D_IN THEN DA<='1';
ELSE DA<='0';
END IF;
END PROCESS P3;
END behav;
我改了一下，clk1和clk2为两个输入信号端，非时钟。
LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;
USE IEEE.STD_LOGIC_UNSIGNED.ALL;
ENTITY zdz IS
PORT(CLK1:IN std_logic; --加1输入信号
CLK2:IN std_logic; --减1输入信号
RST:IN std_logic;
DA :OUT std_logic; --LED指示信号
DATA:OUT std_logic_vector(7 DOWNTO 0));
END zdz;
ARCHITECTURE behav OF zdz IS
SIGNAL D_OUT: std_logic_vector(7 DOWNTO 0);
BEGIN
P1:PROCESS(CLK1,CLK2,RST)
BEGIN
IF RST='1' THEN D_OUT<="00001000";
ELSIF clk1='1' THEN
D_OUT<=D_OUT+1;
ELSIF clk2='1' THEN
D_OUT<=D_OUT-1;
END IF;
END PROCESS P1;
-----------------------------------------
P3:PROCESS(D_OUT)
VARIABLE D_IN : STD_LOGIC_VECTOR(7 DOWNTO 0):="00001000";
BEGIN
IF D_OUT > D_IN THEN DA<='1';
ELSE DA<='0';
END IF;
END PROCESS P3;
DATA<=D_OUT;
END behav;
LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;
USE IEEE.STD_LOGIC_UNSIGNED.ALL;
ENTITY zdz IS
PORT(CLK1:IN std_logic; --加1输入信号
CLK2:IN std_logic; --减1输入信号
RST:IN std_logic;
DA :OUT std_logic; --LED指示信号
DATA:OUT std_logic_vector(7 DOWNTO 0));
END zdz;
ARCHITECTURE behav OF zdz IS
SIGNAL D_OUT: std_logic_vector(7 DOWNTO 0);
BEGIN
P1:PROCESS(CLK1,CLK2,RST)
BEGIN
IF RST='1' THEN D_OUT<="00001000";
ELSIF clk1='1' THEN
D_OUT<=D_OUT+1;
ELSIF clk2='1' THEN
D_OUT<=D_OUT-1;
END IF;
END PROCESS P1;
-----------------------------------------
P3:PROCESS(D_OUT)
VARIABLE D_IN : STD_LOGIC_VECTOR(7 DOWNTO 0):="00001000";
BEGIN
IF D_OUT > D_IN THEN DA<='1';
ELSE DA<='0';
END IF;
END PROCESS P3;
DATA<=D_OUT;
END behav;
共6条
1/1 1 跳转至页
回复
| 有奖活动 | |
|---|---|
| 【有奖活动】分享技术经验，兑换京东卡 | |
| 话不多说，快进群！ | |
| 请大声喊出：我要开发板！ | |
| 【有奖活动】EEPW网站征稿正在进行时，欢迎踊跃投稿啦 | |
| 奖！发布技术笔记，技术评测贴换取您心仪的礼品 | |
| 打赏了！打赏了！打赏了！ | |
| 打赏帖 | |
|---|---|
| 基于MSPM0L1306的MODBUS-RTU协议通讯实验被打赏50分 | |
| 每周了解几个硬件知识+485硬件知识分享被打赏10分 | |
| 【换取手持示波器】树莓派PICOW网页烟花被打赏18分 | |
| 【换取手持示波器】树莓派PICO逻辑分析仪被打赏16分 | |
| 【分享评测，赢取加热台】教你五分钟本地部署蒸馏版本的DeepSeekR1-7B被打赏12分 | |
| 【换取手持示波器】蓝牙音箱更换电池被打赏8分 | |
| 【换取手持示波器】鼠标更换微动开关被打赏10分 | |
| 【我要开发板】4.传感器移植被打赏50分 | |
| 【换取手持数字示波器】RISC-VGCC使用-fno-omit-frame-pointer编译选项实现栈回溯被打赏29分 | |
| 【分享评测，赢取加热台】+开关电源简述被打赏7分 | |
STM32
MCU
通讯及无线技术
物联网技术
电子DIY
板卡试用
基础知识
软件与操作系统
我爱生活
小e食堂