实验名称:实现一个FIFO(先进先出存储器)控制器,将一片普通RAM用作FIFO存储器
完成功能:制作一个FIFO(先进先出存储器)控制器,内部有两个独立的地址指针(读地址和写地址),可以允许数据顺序存入和顺序读出,CPLD将向普通RAM发送地址信号和读写控制信号,并向外设提供读写允许信号。
之前在课堂上学过verilog硬件描述语言,想通过贵网站的DIY活动实现这个实验,能熟练掌握CPLD对各种外设、总线的操作。
打赏帖 | |
---|---|
分享一种检测按键状态的方法被打赏20分 | |
周末总结一下,STM32C0系列的开发经验被打赏50分 | |
【Cortex-M】Systick Timer使用被打赏10分 | |
分享汽车防盗系统的组成与分类(一)被打赏5分 | |
VOFA+波形显示+JYD-31蓝牙发送和解析不定长数据被打赏10分 | |
【换取手持数字示波器】-STM32F4PWM控制LED灯管亮度被打赏22分 | |
【换取手持数字示波器】STM32F4驱动RPR-0521RS照度、接近一体型传感器被打赏23分 | |
宏定义和const关键字定义被打赏5分 | |
【分享开发笔记,赚取电动螺丝刀】几个单片机I2S外设的BLCK时钟对比被打赏20分 | |
【功率监测与控制系统DIY活动成果贴】DIY功率计与LabVIEW数据采集被打赏100分 |