刚开始接触CPLD,我现在用的开发环境是ISE14.2版本的,学习期间问题多多啊,捡其中一两个来向大家请教,请大家多多指导。
1.如下图,程序没有问题,为什么FIT不成功,CPLD编程在哪一步对管脚进行设置,也就是自己定义的和实际芯片管脚联系起来?
2.如下图,怎么对已有的程序进行仿真验证,用自带的软件怎么编写仿真程序?
这个界面不是绑定ucf的,你可以找个例程的ucf,用文本打开看看
头尾固定,中间部分自己定义修改
#PACE: Start of Constraints generated by PACE
#PACE: Start of PACE I/O Pin Assignments
NET "FPIO2" LOC = "p10" ;
#PACE: Start of PACE Area Constraints
#PACE: Start of PACE Prohibit Constraints
#PACE: End of Constraints generated by PACE
说白了,ucf就是芯片物理管脚和内部分配的关联性
有奖活动 | |
---|---|
【有奖活动】分享技术经验,兑换京东卡 | |
话不多说,快进群! | |
请大声喊出:我要开发板! | |
【有奖活动】EEPW网站征稿正在进行时,欢迎踊跃投稿啦 | |
奖!发布技术笔记,技术评测贴换取您心仪的礼品 | |
打赏了!打赏了!打赏了! |
打赏帖 | |
---|---|
与电子爱好者谈读图二被打赏50分 | |
【FRDM-MCXN947评测】Core1适配运行FreeRtos被打赏50分 | |
【FRDM-MCXN947评测】双核调试被打赏50分 | |
【CPKCORRA8D1B评测】---移植CoreMark被打赏50分 | |
【CPKCORRA8D1B评测】---打开硬件定时器被打赏50分 | |
【FRDM-MCXA156评测】4、CAN loopback模式测试被打赏50分 | |
【CPKcorRA8D1评测】--搭建初始环境被打赏50分 | |
【FRDM-MCXA156评测】3、使用FlexIO模拟UART被打赏50分 | |
【FRDM-MCXA156评测】2、rt-thread MCXA156 BSP制作被打赏50分 | |
【FRDM-MCXN947评测】核间通信MUTEX被打赏50分 |