标准单元 ASIC 至 FPGA 设计方法和指南
传统标准单元ASIC的设计成本每年都在增加。除了流片(NRE)和模板成本，开发成本也随着设计复杂度的提高而不断攀升。标准单元ASIC设计中的功耗、信号完整性、时钟树综合以及制造缺陷等问题会带来很大风险，延迟产品面市时间。FPGA能够降低重制风险，减小NRE成本，从而避免了产品延迟面市问题，比传统标准单元ASIC开发更具竞争力。详见an311_CN.pdf。
| 打赏帖 | |
|---|---|
| 【S32K146】S32DS watchdog 配置使用被打赏20分 | |
| 【Zephyr】使用 IAR 调试 Zephyr 镜像被打赏20分 | |
| 【Zephyr】MCXN947 Zephyr 开发入门适配shell被打赏20分 | |
| 【我要开发板】6.联合MATLAB记录数据被打赏50分 | |
| 【瑞萨RA2E1开发板】：使用ADC功能实现位移传感器采集方案被打赏20分 | |
| 【nRF7002DK】基于sht30的温湿度计被打赏20分 | |
| 【nRF7002DK】日志打印被打赏20分 | |
| 【换取手持示波器】RGB屏幕移植ARM-2D库被打赏35分 | |
| 【分享开发笔记，赚取电动螺丝刀】分享一下如何解决瑞萨RA2E1使用printf编译报错问题被打赏27分 | |
| rtthread硬件加密-5hash加密分析被打赏10分 | |
STM32
MCU
通讯及无线技术
物联网技术
电子DIY
板卡试用
基础知识
软件与操作系统
我爱生活
小e食堂