Stratix V 器件Interlaken PHY IP 设计流程
本应用笔记介绍了通过使用Interlaken PHY 知识产权(IP) 接口来实现和仿真Stratix® V 器件中的专有协议PHY IP 内核。通过使用本应用笔记中介绍的参考设计文件,您可以对PHY IP 接口与Stratix V 器件系列的设计流程进行评估。
在Quartus® 10.1 中开始采用的PHY IP 接口会自动配置Stratix V 器件中物理编码子层(PCS) 模块的设置参数,您也可以配置物理介质附加(PMA) 模块中的少量剩余参数。
PHY IP 设计是模块化的并且使用标准接口。所有PHY IP 模块都包含一个连接到访问控制和状态寄存器的Avalon® 存储映像管理接口,以及一个用于数据传输,连接到MAC模块的Avalon Streaming 接口。大多数的PCS 和PMA 功能作为硬核逻辑被实现,以节省FPGA 资源。不要分开或者旁路PCS 和PMA 模块。主要接口是外部接口的串行数据,内部PLD 接口的并行数据以及内部控制接口。详见an634_CN.pdf。
打赏帖 | |
---|---|
汽车电子中巡航控制系统的使用被打赏10分 | |
分享汽车电子中巡航控制系统知识被打赏10分 | |
分享安全气囊系统的检修注意事项被打赏10分 | |
分享电子控制安全气囊计算机知识点被打赏10分 | |
【分享开发笔记,赚取电动螺丝刀】【OZONE】使用方法总结被打赏20分 | |
【分享开发笔记,赚取电动螺丝刀】【S32K314】芯片启动流程分析被打赏40分 | |
【分享开发笔记,赚取电动螺丝刀】【S32K146】S32DS RTD 驱动环境搭建被打赏12分 | |
【分享开发笔记,赚取电动螺丝刀】【IAR】libc标注库time相关库函数使用被打赏23分 | |
LP‑MSPM0L1306开发版试用结果被打赏10分 | |
【分享开发笔记,赚取电动螺丝刀】【LP-MSPM0L1306】适配 RT-Thread Nano被打赏23分 |