我选择第二（一）种方案：申请PCB板，购买组委会提供的元器件包
实验名称：基于CPLD的读取时间，并显示在LDE管上设计
关注这个CPLD的DIY很久了，以前学过的51，F0411，CC2533，STM32等都是C语言编程，虽说有一定的编程基础，但Verilog HDL是初次接触，想通过贵网站的DIY活动实现这个实验，能熟练掌握CPLD对各种外设、总线的操作。自己的方向是高速数据采集，也想为以后的FPGA学习打下基础。
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CPLD DIY申请
好的，申请通过，进入QQ群吧，群号：321628923
现在可以下单了，http://51fpga.taobao.com
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