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我选择第二种方案:申请PCB板,购买组委会提供的元器件包

菜鸟
2013-07-03 21:28:08     打赏

实验名称:基于CPLD数字时钟设计

 

        实验概要:

        完成功能:实时时钟芯片读取时间,按键可设置闹铃值并修改时间值,使用数码管显示时钟,蜂鸣器设置为闹铃,将初始值存放在eepROM里面。开机从里面读取。

 

学过一段时间的verilog,会编程,使用modelsim仿真,一直想有一块开发板练习。乘此机会,可以提升技能。

谢谢。




关键词: cpld diy    

院士
2013-07-04 08:51:32     打赏
2楼
好的,申请通过,进入QQ群吧,群号:321628923
现在可以下单了,http://51fpga.taobao.com

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