请问一下,我编写了一个vhdl的程序,其中包括:
1。 top程序,有两个components: update和sram;
2。 sram程序(模拟FPGA的外接sram);
3。 update程序;
4。 top程序的测试程序。
我用的是xilinx的软件。现在我想对update程序进行时序仿真,应该怎样做呢?我曾经尝试对top程序的测试程序进行仿真,不过好像半天也不出来结果。请教教我,谢谢!
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