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ddr2 high performace controller的使用
各位大侠,我是一个刚入FPGA行业的新手,想问DDR2 IP 核的使用问题:DDR2 HIGH PERFORMACE CONTROLLER 要怎么样用?FPGA芯片是CYCLONE 3的;比如现在在SOPC里面加一个CPU和一个DDR2 controller 生成了一个小系统,更名为"DDR2_SDRAM",同时会生成相关的“DDR2_SDRAM.v”和其他相关的程序。现在想对这个"DDR2_SDRAM.v"进行功能仿真,我在顶层中直接例化了这个程序,在例化之前是不是还要进行相关的设置,比如说激活、刷新、预充、模式设置等等一系列的操作?还是我直接发一个local_weq、local_addr、local_wdata、local_be过去,这个IP核就会在里面进行激活、刷新、预充、模式设置等等这些行为动作。因为之前我在一些文章上看过说:这个IP核的使用就像操作RAM一样简单。但我就直接例化了它也没有什么波形输出来啊,看不到结果;它里面生成的那个实例我也做了一下功能仿真,好像也没有结果输出。各位大侠帮帮小弟吧,我实在是没辙了,公司的项目逼得很紧啦,这几天吃不好,睡不着都在思考这个问题该怎么解决,拜托各位了。
关键词: performace controller 使用
2楼
我只用过Xilinx的DDR2 IP CORE,Altera的没用过。
DDR2 CORE的使用确实比较麻烦。激活、刷新、预充、模式设置等操作应该是有IP CORE来实现的吧,Altera应该有相关的数据手册用来说明IP CORE的使用,你对照着手册,用一个状态机来实现时序。
DDR2 CORE的使用确实比较麻烦。激活、刷新、预充、模式设置等操作应该是有IP CORE来实现的吧,Altera应该有相关的数据手册用来说明IP CORE的使用,你对照着手册,用一个状态机来实现时序。
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