大家好，
我在内陆3线城市的小公司从事fpga应用开发的工作。担心自己没见过世面会成为井底之蛙。
我一直在用verilog，最近听说了systemverilog，听说很强大。想请问大家，进行fpga开发时都是用什么语言写测试文件呢？学习systemverilog有必要吗？
非常感谢！
我觉得用不着特别地去学systemverilog，它本来就是verilog的扩展版本，也与verilog兼容。
对于FPGA而言，测试文件大部分测试都只是测试的程序功能。使用verilog完全足够。并且FPGA还有在线逻辑分析功能。硬件准备好后，还是在线逻辑分析更加可靠。
至于systemverilog，如果是做IC前端调试，还是很有必要的。毕竟IC设计的硬件是在前端后端设计之后的，出硬件前，需要大量的波形、时序分析。
LZ真好，还评分了，谢了
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