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Re: 如何在xilinx的fpga中做一个10ns的延迟单元?谢谢

菜鸟
2005-09-09 15:21:00    评分
输入接到一个D触发器的时钟上,D输入端接1,触发器输出经过个非门后接到 触发器的复位上。调整非门的多少可控制脉宽度。注意不要让优化工具将非门 优化掉了。



关键词: 何在     xilinx     中做     一个     延迟     单元     谢谢    

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