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[置顶] 【福利征集】工程师工作台缺失好物！回帖给我，帮你实现！ EEPW\|浏览：15363\|回复：22\| 嵌入式菜鸟1 14小时前
[置顶] 功能安全，不只是标准问题，更是系统问题 EEPW\|浏览：9542\|回复：2\| andeyqi 4天前
[置顶] EEPW新年祝福 lantu\|浏览：36365\|回复：26\| flyway 2026-03-18 15:55:21
[置顶] 打赏了！打赏了！打赏了！ lantu\|浏览：217458\|回复：46\| jwdxu2009 2026-02-07 09:00:31
[置顶] EEPW会员技术专刊《电子设计与芯片应用》纸质版免费索阅在这里 lantu\|浏览：240002\|回复：23\| jj1230 2025-12-03 18:31:42
关于ISE顶层模块调用子模块时钟问题 haoxin2010\|浏览：7170\|回复：0\| haoxin2010 2012-06-27 22:13:54
高速 XC9500XL 设计计划 Rancho\|浏览：2235\|回复：2\| 指数名家专栏 2012-06-19 11:48:59
利用 2.1i 版软件约束 Virtex 设计 Rancho\|浏览：2689\|回复：0\| Rancho 2012-06-19 11:28:54
一个设计高速度XC9500XV的规划 Rancho\|浏览：2747\|回复：0\| Rancho 2012-06-19 11:28:07
利用 CoolRunner-II CPLD 进行高速设计 Rancho\|浏览：2704\|回复：0\| Rancho 2012-06-19 11:25:22
一个3/4/5/6X路对200 Mb / s到1000 Mb / s串行接口的单频正弦信号电路 Rancho\|浏览：2169\|回复：0\| Rancho 2012-06-19 11:24:35
高级 ChipSync 应用 Rancho\|浏览：2299\|回复：0\| Rancho 2012-06-19 11:21:56
利用数控阻抗:信号完整性和功耗的考虑 Rancho\|浏览：2115\|回复：0\| Rancho 2012-06-19 11:13:21
加速系统设计需要高密度的连接与有针对性的参考设计 Rancho\|浏览：2124\|回复：0\| Rancho 2012-06-19 11:06:42
使用 2.1i 版 Xilinx 设计管理器和流程引擎 (DMFE) Rancho\|浏览：2310\|回复：0\| Rancho 2012-06-19 10:51:05
2.1i 版 FPGA 编辑器 Rancho\|浏览：2408\|回复：0\| Rancho 2012-06-19 10:50:20
2.1i 版布局规划器支持 Virtex FPGA Rancho\|浏览：2635\|回复：0\| Rancho 2012-06-19 10:49:26
利用 6.2i 布局规划器创建 RPM Rancho\|浏览：2140\|回复：0\| Rancho 2012-06-19 10:48:39
PACE 实现前的管脚布局创建 Rancho\|浏览：1822\|回复：0\| Rancho 2012-06-19 10:47:53
利用 Virtex-4 EasyPath FPGA 的“在系统 ECO”功能 Rancho\|浏览：2544\|回复：0\| Rancho 2012-06-19 10:47:03
反思自己的数百万的门级fpga的验证策略 Rancho\|浏览：2103\|回复：0\| Rancho 2012-06-19 10:24:59
与 Synplicity 和 Exemplar 的交叉探测 Rancho\|浏览：2346\|回复：0\| Rancho 2012-06-19 10:22:56
Design Tips for HDL Implementation of Arithmetic Functions Rancho\|浏览：1680\|回复：0\| Rancho 2012-06-19 10:21:52
维护可重复的结果 Rancho\|浏览：2216\|回复：0\| Rancho 2012-06-19 10:18:48
Spartan-6 fpga定位并重新定位使用指南 Rancho\|浏览：2201\|回复：0\| Rancho 2012-06-19 10:17:40
得到智能重置组合:考虑的是当地,而不是全球性的 Rancho\|浏览：1660\|回复：0\| Rancho 2012-06-19 10:15:11
利用 SRL16E 节省成本 Rancho\|浏览：1786\|回复：0\| Rancho 2012-06-19 10:13:15
无需板仿真即可估计实际的输出时序 Rancho\|浏览：1837\|回复：0\| Rancho 2012-06-19 10:12:14
数字锁相环 (DPLL) 参考设计 Rancho\|浏览：2775\|回复：0\| Rancho 2012-06-19 10:07:04
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利用 CoolRunner-II CPLD 创建交叉点开关 Rancho\|浏览：2144\|回复：0\| Rancho 2012-06-19 10:02:24
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适用于 Virtex-4 RocketIO MGT 的开关电源 Rancho\|浏览：2318\|回复：0\| Rancho 2012-06-19 09:56:00
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Virtex-4 RocketIO 误码率测试器 Rancho\|浏览：1936\|回复：0\| Rancho 2012-06-19 09:40:36
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在数字视频应用中使用 CoolRunner-II CPLD Rancho\|浏览：1988\|回复：0\| Rancho 2012-06-19 09:37:59
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