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[置顶] EEPW会员技术专刊《电子设计与芯片应用》纸质版免费索阅在这里 lantu\|浏览：283732\|回复：23\| jj1230 2025-12-03 18:31:42
Verilog的常数的声明（parameter和define）【FPGA/CPLD】 0750long\|浏览：5072\|回复：3\| Jason_Zhang 2009-03-19 16:59:06
Verilog中integer与reg的区别【FPGA/CPLD】 0750long\|浏览：8269\|回复：2\| Jason_Zhang 2009-03-19 12:37:40
状态机中的状态编码需要小心【FPGA/CPLD】 0750long\|浏览：3051\|回复：3\| Jason_Zhang 2009-03-19 12:26:40
[原创]usb2.0增强型DSP仿真器【DSP系统】 xhx6616\|浏览：4939\|回复：3\| Avile 2009-03-18 20:57:18
新一代半导体IC封装的发展TheDevelopmentofNewGenerationIC 【FPGA/CPLD】 0750long\|浏览：2402\|回复：0\| 0750long 2009-03-18 17:22:35
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台湾的IC设计环境----值得学习【FPGA/CPLD】 0750long\|浏览：3205\|回复：0\| 0750long 2009-03-18 15:20:20
基于FPGA技术的存储器设计及其应用【FPGA/CPLD】 0750long\|浏览：2765\|回复：0\| 0750long 2009-03-18 12:55:45
蓝牙HCI-UART与并口的FPGA控制接口设计【FPGA/CPLD】 0750long\|浏览：8704\|回复：0\| 0750long 2009-03-18 12:54:47
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ISE时序约束笔记8——Achieving Timing Closure 【FPGA/CPLD】 0750long\|浏览：5563\|回复：0\| 0750long 2009-03-18 10:17:40
请教如何将一个pulse从一个时钟域传到另外一个时钟域【FPGA/CPLD】 Jason_Zhang\|浏览：2586\|回复：0\| Jason_Zhang 2009-03-17 14:07:14
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