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FPGA  -  输入

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VHDL的二维数组输入输出 【FPGA/CPLD】
zsy5460|浏览：10500|回复：1| dreamjsc 2012-04-13 12:53:21
请问，时序中的I/O输入最大延迟减去输出的最小延迟是不是就是数据的建立时间 【FPGA/CPLD】
站的高尿的远|浏览：2746|回复：2| huxiaokai2005 2012-02-21 15:36:10
FIR滤波器输入问题 【FPGA/CPLD】
站的高尿的远|浏览：3053|回复：3| huxiaokai2005 2012-02-18 23:25:55
[精华] SOPC设置的IO口是下降沿中断输入方式，为什么会把外部信号拉低呢？ 【FPGA/CPLD】
zyz881216|浏览：9182|回复：10| 笑揖春风 2012-02-18 20:27:51
Verilog中文件输入与输出任务实例解析 【FPGA/CPLD】
dreamjsc|浏览：3995|回复：0| dreamjsc 2011-11-07 17:24:21
[精华] 特殊图元的使用 【FPGA/CPLD】
271303204|浏览：3779|回复：5| jpp 2011-08-07 19:54:28
为何以原理图作为输入的案例比较少呢？ 【FPGA/CPLD】
CRRBravery|浏览：2254|回复：2| CRRBravery 2011-07-19 09:17:05
CyloneII时钟输入问题 【FPGA/CPLD】
wangfanlion|浏览：2610|回复：2| jomatch 2010-07-30 09:29:36
求助：数据的输入 【FPGA/CPLD】
lovewtg|浏览：3997|回复：12| blueskyliu 2010-05-26 16:29:43
请问在altera中用原理图输入的工程可以在modelsim中仿真吗？ 【FPGA/CPLD】
271303204|浏览：3510|回复：1| Jason_Zhang 2009-11-02 16:20:03
常用电平标准 【FPGA/CPLD】
风语者|浏览：1945|回复：1| 271303204 2009-03-26 09:36:21
六种简单装置 （异步电路技巧） 【FPGA/CPLD】
Jason_Zhang|浏览：4027|回复：2| Jason_Zhang 2009-01-20 09:35:55
dsp电平转换的方法介绍 【DSP系统】
dilingling|浏览：3112|回复：3| 张阳 2008-06-10 17:14:34
晒板子（转） 【DSP系统】
beibeidong|浏览：2292|回复：0| beibeidong 2008-06-05 16:15:19
CIC Xilinx FPGA trainning - 状态机图形输入 【FPGA/CPLD】
Hongjun|浏览：2470|回复：0| Hongjun 2008-06-02 08:18:20
CIC Xilinx FPGA training - 图形输入 【FPGA/CPLD】
Hongjun|浏览：2515|回复：0| Hongjun 2008-06-01 10:23:23
非常好的DSP扫盲文章(ZZ)( 【DSP系统】
zhangaax|浏览：2259|回复：0| zhangaax 2008-02-20 08:56:49
求 3v~9v输入，5v输出的IC或电路? 【DSP系统】
skywonderful|浏览：4269|回复：4| 叮叮当当 2007-11-14 00:23:51
对高阻抗缓冲放大器的输入实现ESD保护 【FPGA/CPLD】
star800|浏览：2782|回复：1| 叮叮当当 2007-11-10 18:01:50
请问Cyclone怎么输入时钟啊? 【FPGA/CPLD】
skywonderful|浏览：3200|回复：2| 叮叮当当 2007-11-10 17:36:34
推荐一个输入3－8v，输出5v >500mA的电源模块 【FPGA/CPLD】
fanghlin|浏览：2776|回复：0| 2005-08-17 22:11:00
（求助）如何通过键盘输入来控制DSP 【DSP系统】
zdyaini|浏览：2464|回复：0| 2004-08-21 12:02:33
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