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初学verilog问题 【FPGA/CPLD】
imeradio|浏览：4109|回复：10| Jason_Zhang 2010-04-18 12:16:46
【求助】dsp中外设在I/O空间映射的问题 【DSP系统】
gzc2757343|浏览：3703|回复：1| 艾科瑞德 2010-04-14 09:52:01
modelsim时序仿真时为何死掉了？ 【FPGA/CPLD】
becoll|浏览：3349|回复：3| Jason_Zhang 2010-04-12 11:04:42
时仿出问题了寻求way out 【FPGA/CPLD】
becoll|浏览：2021|回复：1| Jason_Zhang 2010-04-11 21:30:01
CYCLONE 3C120电路图（分享） 【FPGA/CPLD】
Jason_Zhang|浏览：3979|回复：5| Jamesblunt 2010-03-12 13:59:22
Sampling and Multirate Techniques for Complex and Bandpass Signals（分享） 【FPGA/CPLD】
Jason_Zhang|浏览：1988|回复：0| Jason_Zhang 2010-02-02 12:31:19
DSP总结3 【DSP系统】
abbing|浏览：4539|回复：4| yzx0xyz 2010-01-29 10:25:49
一个用modlesim后仿真的问题 【FPGA/CPLD】
thinkts|浏览：4057|回复：1| Jason_Zhang 2010-01-28 10:08:01
Synopsys RTL coding（分享） 【FPGA/CPLD】
Jason_Zhang|浏览：2532|回复：0| Jason_Zhang 2010-01-20 00:50:23
Synplify Pro QuickStart（分享） 【FPGA/CPLD】
Jason_Zhang|浏览：2010|回复：0| Jason_Zhang 2010-01-17 21:58:39
[转帖]Altera公司今天正式推出Nios™ II集成开发环境（IDE）。 【FPGA/CPLD】
xiaohua|浏览：4572|回复：3| xilinxic 2010-01-09 15:59:22
ALtera公司的SOPC设计手册 【FPGA/CPLD】
Jason_Zhang|浏览：2034|回复：0| Jason_Zhang 2010-01-03 13:27:43
关于synplify pro 的compile points的疑问 【FPGA/CPLD】
becoll|浏览：2761|回复：1| Jason_Zhang 2009-12-20 18:12:44
FSM-based Digital Design using Verilog HDL（分享） 【FPGA/CPLD】
Jason_Zhang|浏览：4042|回复：0| Jason_Zhang 2009-12-20 15:59:28
modelsim时序仿真apply to region处怎么设置？ 【FPGA/CPLD】
becoll|浏览：4274|回复：2| Jason_Zhang 2009-12-19 00:44:18
Art of Writing TestBenches（分享） 【FPGA/CPLD】
Jason_Zhang|浏览：2065|回复：0| Jason_Zhang 2009-12-18 12:30:05
有谁知道Syplify Pro的最新版是哪个吗？ 【FPGA/CPLD】
Jason_Zhang|浏览：3744|回复：4| Jason_Zhang 2009-12-15 19:19:27
Mobile SDRAM 助你完成低功耗便携式产品开发 【DSP系统】
lizaofei168|浏览：2807|回复：0| lizaofei168 2009-12-11 17:12:38
关于synplify pro指示的关键路径 【FPGA/CPLD】
becoll|浏览：3073|回复：2| becoll 2009-12-09 15:37:52
chipscope中如何保存设置 【FPGA/CPLD】
becoll|浏览：2545|回复：1| Jason_Zhang 2009-12-09 10:06:47
请教：2812的BIOS HWI问题 【DSP系统】
maoyong53|浏览：3513|回复：2| pheigenbaum 2009-12-02 20:13:51
具有什么特征的内部信号可以被chipscope观察？ 【FPGA/CPLD】
becoll|浏览：2925|回复：1| Jason_Zhang 2009-11-25 10:42:46
chipscope中如何观察双向口信号？ 【FPGA/CPLD】
becoll|浏览：9020|回复：5| becoll 2009-11-20 15:12:10
编译后Warning: Macrocell buffer inserted after node "FST"是什么意思？ 【FPGA/CPLD】
cjz306|浏览：5561|回复：4| Jason_Zhang 2009-11-18 12:54:00
SOC设计领域的核心技术——软/硬件协同设计 【FPGA/CPLD】
Jason_Zhang|浏览：2452|回复：0| Jason_Zhang 2009-11-16 13:38:56
modelsim可以保存仿真多长时间的波形 【FPGA/CPLD】
becoll|浏览：8105|回复：6| Jason_Zhang 2009-11-15 12:02:46
在modelsim中用testbench仿真，怎样才能更新generic的值? 【FPGA/CPLD】
becoll|浏览：4475|回复：2| becoll 2009-11-13 11:15:47
请问在altera中用原理图输入的工程可以在modelsim中仿真吗？ 【FPGA/CPLD】
271303204|浏览：3495|回复：1| Jason_Zhang 2009-11-02 16:20:03
modelsim如何固定仿真信号显示的顺序？ 【FPGA/CPLD】
becoll|浏览：5281|回复：3| Jason_Zhang 2009-10-28 18:08:06
modelsim是否可以保存仿真结果？ 【FPGA/CPLD】
becoll|浏览：4598|回复：3| Jason_Zhang 2009-10-28 13:56:46
基于门控时钟的CMOS电路低功耗设计 【FPGA/CPLD】
Jason_Zhang|浏览：2679|回复：1| bobliu9111 2009-10-15 11:04:02
Nios II 与 IP核验证平台（ALTERA & XILINX & LATTICE ： CPLD & FPGA )开发板，软件与下载线 【FPGA/CPLD】
socway|浏览：4080|回复：1| cjfwindy 2009-09-23 21:40:38
转电子科大tony的工作经验 【FPGA/CPLD】
Jason_Zhang|浏览：2361|回复：4| Jason_Zhang 2009-09-21 09:57:54
Quartus II 与 ModelSim 功能仿真与后仿真扫盲 【FPGA/CPLD】
Jason_Zhang|浏览：3991|回复：5| gglight 2009-09-18 16:53:44
关于调试NISO时，flash出现的问题 【FPGA/CPLD】
shensheriyue|浏览：3414|回复：2| 271303204 2009-09-08 16:06:01
继续求助状态机的问题 【FPGA/CPLD】
风语者|浏览：3860|回复：12| Jason_Zhang 2009-08-27 18:22:43
Verilog HDL的有限状态机(1).pdf 【FPGA/CPLD】
jchg|浏览：2353|回复：2| Jason_Zhang 2009-08-16 22:55:58
SoC低功耗设计技术发展综述（分享） 【FPGA/CPLD】
Jason_Zhang|浏览：1770|回复：0| Jason_Zhang 2009-08-14 15:32:31
Altera Nios嵌入式处理器知识讲座 【FPGA/CPLD】
cuipeng|浏览：3373|回复：7| 佚枫 2009-08-12 11:00:21
求助状态机 【FPGA/CPLD】
风语者|浏览：2684|回复：6| 风语者 2009-08-05 14:06:10
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