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今日说“法”：TimeQuest约束外设之诡异的CreateGeneratedClocks 【FPGA/CPLD】
FPGA江湖|浏览：672|回复：2| FPGA江湖 2024-06-05 16:23:38
国产FPGA核心板！米尔紫光同创Logos-2和XilinxArtix-7核心板 【FPGA/CPLD】
myir米尔|浏览：428|回复：0| myir米尔 2024-05-31 17:38:09
XC6SLX9烧写到SPIFLASH提示DONEdidnotgohigh,pleasecheckyourconfigurationsetupandmodeset
hello110300509|浏览：956|回复：0| hello110300509 2023-09-06 16:57:15
Arm架构下的Synchronization概述和案例分析
卢风|浏览：895|回复：1| springvirus 2023-08-18 09:12:58
Vivado使用进阶：读懂用好TimingReport 【FPGA/CPLD】
FPGA江湖|浏览：616|回复：2| yzw92 2023-07-12 07:00:00
今日说“法”：TimeQuest之迷失的“delayfallclockfall” 【FPGA/CPLD】
FPGA江湖|浏览：373|回复：0| FPGA江湖 2023-05-15 15:53:04
VitisHLS介绍及工作流程
卢风|浏览：1317|回复：13| 风的印记 2022-09-18 23:57:34
[精华] 吐血奉献---TI DSP系列中文手册《TMS320C6000系列DSP的CPU与外设 【DSP系统】
halibote523|浏览：15268|回复：50| mumin 2022-08-03 11:13:17
论坛里怎么很少人讨论TI较新的DSP芯片？ 【DSP系统】
zhangsfan|浏览：400|回复：0| zhangsfan 2022-06-29 16:31:12
multiboot什么意思？MultiBoot的功能简介、流程介绍
Dummer3|浏览：1408|回复：6| 南望 2022-01-09 23:41:04
想咨询下 ZYNQ的DSP单元有多强悍？和TI的8核DSP TMS320C6678比有什么区别吗? 【FPGA/CPLD】
站的高尿的远|浏览：3593|回复：3| 无厘头 2021-12-16 23:52:37
基于StratixⅡ的加法树设计及其应用
风的印记|浏览：517|回复：0| 风的印记 2021-06-10 23:51:28
赛灵思自曝八大秘笈(8)：Vivado HLS中Floating-Point（浮点）设计编码风格与技巧 【FPGA/CPLD】
wangying|浏览：3971|回复：6| serfei 2021-03-26 14:32:57
基于MAX1951实现StratixIIFPGA系统供电的设计方案
船长demons|浏览：556|回复：2| 清歌孤我 2021-01-10 21:10:29
Verilog HDL中task与function的区别 【FPGA/CPLD】
span14|浏览：1677|回复：1| zxopenljx 2020-12-27 11:36:36
Altium.Designer基于FPGA系统设计功能培训 【FPGA/CPLD】
zxopenljx|浏览：1219|回复：5| Dummer3 2020-10-26 21:21:09
Altium.Designer原理图和PCB设计 【FPGA/CPLD】
zxopenljx|浏览：991|回复：6| Dummer3 2020-10-26 21:11:19
lattice，altera，xilinx三合一的图像转rom，mif软件
lichenllin|浏览：767|回复：1| 无厘头 2020-08-30 15:13:36
celestin Robei FPGA进程帖 【FPGA/CPLD】
celestin|浏览：3206|回复：6| zxopenljx 2020-08-27 10:17:07
CIC Xilinx FPGA trainning - Timing constraints 【FPGA/CPLD】
Hongjun|浏览：2627|回复：1| zxopenljx 2020-08-12 10:01:58
TI C2000编译器的错误信息列表 【DSP系统】
paradoxfx|浏览：3000|回复：11| zxopenljx 2020-07-25 16:04:24
基于FPGAXlinxArtix7平台的声源定位装置设计
船长demons|浏览：1090|回复：1| Dummer3 2020-07-21 21:56:18
感兴趣的朋友可以看看
175zyt|浏览：1635|回复：1| 清歌孤我 2020-07-05 13:20:45
lattice 的CPLD 和FPGA 【FPGA/CPLD】
jerrylvan|浏览：4729|回复：1| zxopenljx 2020-07-04 15:38:56
【TI技术文章】：KeyStone存储器架构 【DSP系统】
DSP新天地|浏览：2300|回复：1| zxopenljx 2020-06-25 09:38:12
请问Xilinx SDK中与FPGA连接后 Terminal Settings 中，Port 应该是什么啊？ 【FPGA/CPLD】
站的高尿的远|浏览：3660|回复：1| ygpygp1234 2020-05-15 13:57:12
sitime可编程晶振尺寸对应图 【FPGA/CPLD】
yangxingkeji11|浏览：1693|回复：3| zxopenljx 2020-04-18 14:46:33
TIDSP为啥连接不上？JTAG接口无法连接的问题
Dummer3|浏览：847|回复：0| Dummer3 2020-03-18 21:59:16
Artix7板子中调试FPGA不能启动的问题
Dummer3|浏览：589|回复：0| Dummer3 2020-03-18 21:58:37
[转]智能音箱不止能听——TIDLPPico技术打造卓越的智能显示体验
路人甲123|浏览：906|回复：1| 船长demons 2020-03-04 22:07:12
LatticeMachXO2控制开发板的特性及原理图
船长demons|浏览：1139|回复：1| 无厘头 2020-01-23 18:52:56
转发“Verilog HDL高级数字设计(第2版)(英文版)_[M D.Ciletti 著][Prentice Hall][2010][984页]” 【FPGA/CPLD】
SYD2012|浏览：28034|回复：116| dsbssb 2019-11-25 21:54:23
TI DSP常用例程 【DSP系统】
小江湖|浏览：35420|回复：155| aoxiang0530 2019-09-04 09:41:59
有谁弄过MCU通过SSPI方式配置 LATTICE XO3 XO2 CPLD的？
bajuntu|浏览：1214|回复：0| bajuntu 2019-09-02 08:27:40
巧用Vivado中的Intime 设计探索工具优化RTL代码 【FPGA/CPLD】
NuclearLiu|浏览：1151|回复：0| NuclearLiu 2019-04-17 23:38:34
TI C5000编译器的错误信息列表 【DSP系统】
paradoxfx|浏览：2348|回复：6| pxmneu 2019-04-10 10:32:57
Virtex-7 FPGA Gen3 Integrated Block Completion timeout机制 【FPGA/CPLD】
wangying|浏览：3879|回复：2| shengxiong 2019-01-22 14:38:43
手把手教你制作XDS100v3仿真器,亲测，验证通过 【DSP系统】
EMIC199|浏览：13623|回复：14| rogersmr 2018-11-06 11:01:24
ccsv5研讨会讲义 【DSP系统】
paradoxfx|浏览：5708|回复：17| qqqljx 2018-01-23 10:11:10
Xilinx SelectIO资源的使用总结 【FPGA/CPLD】
mhx3211|浏览：1849|回复：0| mhx3211 2017-06-29 13:52:11
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