我用的是MAX7000S系列(EPM7160S),电路板上根据需要将VCCIO连到了3.3V,想让用户IO的输出脚输出3.3V的高电平。但是在Quartus II的Processing-Complilation Report-Pin_out_File中显示VCCIO为5V(见下面),上电后发现各个IO输出脚确实是5V的高电平,而不是VCCIO的物理连接(3.3V)所确定的3.3V,该如何设置Quartus中VCCIO相关的东西,让CPLD的IO输出脚输出3.3V高电平?
请各位大侠指点,万分感谢!
Pin Name/Usage : Location : Dir. : I/O Standard : Voltage
VCCIO : 26 : power : : 5.0V
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