关于如何设计双向IO总线的testbench 测试程式，网上有些资料会涉及到，但我看了觉得并不深入。
由于本人刚刚学习verilog，在学一个I2C slave。但在写测试测试时面对SDA这种双向信号不知如何写
在主程式中已定义好sda为双向信号，如：IBUF sda_ibuf (.I (sda_io), .O (sda_in));
OBUFE sda_obuf (.I (1'b0), .E (drive_sda), .O (sda_io));
drive_sda为控制三态门的开关，为内部的信号，并非外部输入。那么请问各位高手，如何写测试程式得到sda在规定的时段进行输入或输出的切换呢！
急盼指教！
非常感谢！
共6条
1/1 1 跳转至页
如何设计双向IO总线的testbench 测试程式--高手请进
dear Jason:我搜到你发表的帖子了，内容如下。你说的是oe应该是输入，可在我这个model中oe是由此model中内部信号产生，请问在仿真时是否应该在主程式中把产生它的部分程式mask掉，且把它定义为输入，这样才能在testbench中定义它把波形仿真出来呢？
非常感谢！
一般情况下，如果你所要描述的器件是个总线从设备，那么oe应该是个输入，由Testbench产生oe。正如由CPU控制RAM的读写一样。
这正好和你的描述是相反的。
assign DD = oe? ddo : 16’bz;
assign ddi = DD;
testbench：
`timescale 1ns / 1ps
initial
begin
#100;
oe = 1;
#20;
testReg = DD;
#100;
oe = 0;
#10;
DD = 16'd1;
#200;
end
......
非常感谢！
一般情况下，如果你所要描述的器件是个总线从设备，那么oe应该是个输入，由Testbench产生oe。正如由CPU控制RAM的读写一样。
这正好和你的描述是相反的。
assign DD = oe? ddo : 16’bz;
assign ddi = DD;
testbench：
`timescale 1ns / 1ps
initial
begin
#100;
oe = 1;
#20;
testReg = DD;
#100;
oe = 0;
#10;
DD = 16'd1;
#200;
end
......
共6条
1/1 1 跳转至页
回复
| 打赏帖 | |
|---|---|
| 【Zephyr】使用Zephyr外设初始化过程解析被打赏30分 | |
| 【S32K146】S32DS watchdog 配置使用被打赏20分 | |
| 【Zephyr】使用 IAR 调试 Zephyr 镜像被打赏20分 | |
| 赚取电动螺丝刀+电源电路理论知识分享1被打赏5分 | |
| 我想要一部加热台+分享常见运算放大器电路的应用被打赏5分 | |
| 【Zephyr】MCXN947 Zephyr 开发入门适配shell被打赏20分 | |
| 我想要一部加热台+常见的MOS管驱动电路被打赏5分 | |
| 【我要开发板】6.联合MATLAB记录数据被打赏50分 | |
| 【换取手持数字示波器】MicrochipMPLABHarmony框架下串口调试printf输出记录被打赏29分 | |
| 【瑞萨RA2E1开发板】：使用ADC功能实现位移传感器采集方案被打赏20分 | |
STM32
MCU
通讯及无线技术
物联网技术
电子DIY
板卡试用
基础知识
软件与操作系统
我爱生活
小e食堂