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VHDL,Verilog,System verilog比较

苏丹红
助工
2013-03-12 22:29:35     打赏

本文简单讨论并总结了VHDL、Verilog，System verilog 这三中语言的各自特点和区别

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关键词： Allegro     allegro总结     Allegro    

mingfeixu
菜鸟
2013-04-01 19:08:49     打赏
2楼
谢谢分享

评论
haitao2000s
工程师
2013-04-02 11:06:49     打赏
3楼
看看

评论
Patterson
助工
2013-04-02 21:00:28     打赏
4楼
好东东啊

评论
啸风
专家
2013-04-02 21:39:34     打赏
5楼
东西不错啊  发错版块了  我给你移过去

评论
jeffreychen
工程师
2013-04-03 13:04:36     打赏
6楼

Good, this is what I need !!

Thanks.


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lidonglei1
高工
2013-04-04 09:33:28     打赏
7楼
悄悄

评论
HXW718059156
高工
2013-04-05 09:38:58     打赏
8楼
System Verilog还没有用过，了解一下

评论
Altium12a
菜鸟
2013-04-05 12:51:36     打赏
9楼
我觉得差不多。

评论
qq729101414
工程师
2013-04-09 12:02:38     打赏
10楼
学习了。、、、、

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