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用Cadence Allegro进行PCB级的信号完整性仿真

助工
2013-03-20 08:57:42     打赏

 随着信息宽带化和高速化的发展 以前的低速 已完全不能满足日益增长信息化发展的需要 而 高速 的出现将对硬件人员提出更高的要求 仅仅 依靠自己的经验去布线 会顾此失彼 造成研发周期 过长 浪费财力物力 生产出来的产品不稳定 一般 认为高速 是指其数字信号边沿上升时间小于 倍信号传输时延 这种高速 的信号线必须按照传 输线理论去设计 否则将会严重影响信号的完整性 公司针对 发布一个功能 非常实用的高速电路设计及信号完整性分析的工具选 件 利用这个仿真软件能够根据 叠层的排序 的介电常数 介质的厚度 信号层 所处的位置以及线宽等等来判断某一 线条是否 属于微带线 带状线 宽带耦合带状线 并且根据不 同的计算公式自动计算出信号线的阻抗以及信号的反 射 串绕 电磁干扰等等 从而可以对布线进行约束 以保证 的信号完整性 下面根据我们的具体实 践 介绍其基本使用方法 由于我们在实际设计过程中 通常使用 进行电路前期设计 得到的是电路的 文件 为了利 用 进行电路仿真 首先需要将 的 文件转换为 的 文件 完成这一转 换的工具是 公司提供的一组附件 该附件包含 个文件 分别是 和 使用时 需要设置好路径和环境变量 然后运行 文件 在提示下输入所要转换 的 文件名 就可以将 文件转换为 文件 但是需要特别注意的是 转换后的 文件与原来的 文件相比有一些隐蔽性的问题 列举如下 ! 首先 元件的焊盘名和封装名会出现问题 在 中合法的命名规则在 中则可能 不合法 例如 ! 在 中可这样定义一个封装名 " #$ % & " ' & " &( 但是在转换至 的 文 件 时 会 转 变 为 ......

 

 

 

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