如何最优设计PMOS过压保护电路？

工程师

2020-01-11 17:05:01 打赏

下图实验结果为：输入5V-50V，输出在PMOS管漏级未上拉或下拉直接输出时，几乎等于输入，未体现到输入12V过压保护功能，若漏级输出接上拉电源或下拉到地，则在输入＞12V时，输出与上拉或下拉的电位有关。

提问：1、实际用在电源输入的时候，PMOS管漏级接下拉电阻对接到地可否？2、为何PMOS管漏级未上拉或下拉直接输出时，按说PMOS管已经断开，为何还有电压?3、怎么判断PMOS管已经关断？

关键词：如何最优设计过压保护电路

工程师

2020-01-11 17:50:32 打赏

2楼

楼主的电路有些复杂，用运放做比较器实现过压保护，不是更简单些吗？

工程师

2020-01-11 18:49:30 打赏

3楼

图有些小，看不清，建议EEPW能实现点击放大。不然，我想回答都不太方便

工程师

2020-01-11 22:06:10 打赏

4楼

帮你顶一下让高手来回答

高工

2020-01-12 20:46:53 打赏

5楼

首先你的输入输出电压得弄的很到位吧

工程师

2020-01-13 21:29:41 打赏

6楼

建议采用运放电路做保护

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