用7128S做了一个分频器，输入时钟为1KHz的，10分频输出。输入的时钟信号抖动较大，在上升沿有快速起伏，引起了分频器工作不稳定。想请教各位高手，如何实现滤除这些信号抖动？在电路外面加滤波的方法都用过了，效果不大，想做到7128S内部实现。
谢谢了啊！
[align=right][color=#000066][此贴子已经被芝麻开花于2005-6-1 19:49:33编辑过][/color][/align]共3条
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谢谢朋友！
我也想到了，用DFF去采样该时钟信号就可以。但高频信号的应该如何选合适？
还有，我的VHDL程序编译完后有这个信息“infNOT gate push-back has occurred on same registers-if power-up condition is crucial to the operation of the circuit ,use the asynchronous clear/preset on the register to ensure proper operation”该如何解决？
请高手赐教！感谢！
[align=right][color=#000066][此贴子已经被作者于2005-5-24 19:51:16编辑过][/color][/align]共3条
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