可是如何设置不用的管脚为高阻态呢?我用的是XILINX的FPGA,如果代码里没有写的引脚,或是代码里设置输入输出但没有用到的引脚,在约束文件里约束位置了,但实现不了,好像全是输入引脚,会报错,其它的都会报警告.
现在是知道不用的引脚设置高阻了,但怎么设置呢?
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