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verilog模块编程要点(转载)

高工
2009-06-02 09:23:15     打赏
verilog模块编程要点

1. 时序电路建模时,用非阻塞赋值。

2.锁存器电路建模时,用非阻塞赋值。

3.用always块建立组合逻辑模型时,用阻塞赋值!

4.在同一个always块中建立时序和组合逻辑电路时,用非阻塞赋值。

5.在同一个always块中不要既用非阻塞赋值又用阻塞赋值。

6.不要在一个以上的always块中为同一个变量赋值。

7.用$strobe系统任务来显示用非阻塞赋值的变量值。

8.在赋值时不要使用#0延迟。

看到这个觉得还比较有用,转来大家共享



关键词: verilog     模块     编程     要点     转载    

助工
2009-06-02 11:39:02     打赏
2楼
的确,有好多都是犯过错误才知道的,就是没有像这么总结过!好东西,值得分享!

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