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电子产品世界 » 论坛首页 » 嵌入式开发 » FPGA » 如果需要多路频率相同，但相位不同的时钟信号，改怎么办呢？

共13条 2/2 ‹ 1 2 跳转至页
Jason_Zhang
高工
2009-07-05 11:25:52     打赏
11楼

还要看他的这些时钟是用在哪里的。
200M，延时1ns，这些时钟我想不出在FPGA中怎么用。FPGA中应该同步设计。
如果是在外部用，可以由同一个时钟经过不同的RC延时网络来实现。


评论
271303204
助工
2009-07-06 10:49:22     打赏
12楼
时钟用在fpga内部的，使用pll的话，相移可以到ps级，可惜输出端太少了，呵呵
不过门级延时到也算是一个方法

评论
Jason_Zhang
高工
2009-07-06 12:31:14     打赏
13楼
ps级是不可能的，1ps=100GHz，到毫米波段了，即使是理论值，也不可能实现。

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