用ISE综合时报如下错误：
Port <clk100> has illegal connections. This port is connected to an input buffer and other components
clk100是我用的系统时钟，作为输入，当然要接input buffer，然而我的工程有很多子模块，当然也要将clk100连到各个component，报这个错究竟是啥意思呢？
2楼
对于时钟我一般是这么用的，时钟输入进来后先过一个DCM，即使没有倍频分频，可可以整形。然后再接给系统中的各个模块做时钟。
我觉得你可以把input buffer的输入接给各个component试试看
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