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求综合错误原因

becoll
工程师
2010-04-04 16:42:11     打赏
用ISE综合时报如下错误：
Port <clk100> has illegal connections. This port is connected to an input buffer and other components
 clk100是我用的系统时钟，作为输入，当然要接input buffer，然而我的工程有很多子模块，当然也要将clk100连到各个component，报这个错究竟是啥意思呢？
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关键词： 综合     错误     原因    

becoll
工程师
2010-04-04 17:04:40     打赏
2楼

这是使用synplify pro 综合报的错：
Port 'clk100' on Chip 'cpu' drives 1 PAD loads and 398 non PAD loads
“把input buffer的输入接给各个component试试看”这是什么意思呢？
是不是应将系统时钟输入给DCM，然后用DCM的输出去驱动各个component？


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becoll
工程师
2010-04-04 18:37:03     打赏
3楼
非常感谢！
问题已经解决，原因是我的一个子模块中调用了个DCM，我把它移到顶层模块后就好了~

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becoll
工程师
2010-06-02 08:34:06     打赏
4楼
请问手动加BUFG该怎么加啊？我以前看别人在原理图中可以直接调用一个BUFG模块，但不知道用代码的方式该如何加？

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