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电子产品世界 » 论坛首页 » 嵌入式开发 » FPGA » 求助，MODELSIM仿真输出为红线U

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Jason_Zhang
高工
2010-05-18 20:20:29     打赏
11楼

你看看Modelsim给出的waining

高阻Z，应该是没有给正确的激励。检查你的复位


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xlrock
菜鸟
2010-05-19 11:19:11     打赏
12楼

问题已解决！！！感谢老版的大力帮助，我的毕业设计终于完成了
是因为未将所有的ALTER、DSP BUILDER的库编译入LIBERARY
之后将DSP-BUILDER自动生成的所有HDL语言文件都导入WORK中
用MODELSIM自带的TESTBENCH生成方法就可以进行测试了！
上图！


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xlrock
菜鸟
2010-05-19 11:23:53     打赏
13楼
建立 LIBERARY    NAMED   altera和 lpm
ALTER库的位置：  D:\altera\81\quartus\eda\sim_lib

dsp builder库的位置： D:\altera\81\quartus\libraries\vhdl\altera

编译入库时要注意编译的顺序，在提示下如果缺少什么库就编译什么库先

特别要注意：编译  220model.v  altera_mf.v  220pack.vhd 等基本库的编译

DSP-BUILDER真是个好东西，推荐大家学习使用

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