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CD4093BC 有关CD4093BC的问题

问
前天看有人在介绍cd4093,就在21ic上把它的data sheet下下来了,但是有问题不懂,请高手指点。
如图所示,为什么方波信号VIN经过电容后再上拉(或下拉)后,输出vin的上升沿和下降沿不一样? 答 1: 为什么我的图发不上去阿? 答 2: 因为输入端有二极管箝位。所以图1输入高电平时高不去;图2输入低电平时低不下。注意输入端的电流不能太大,否则可能会搞坏输入端的。 答 3: 没有二极管啊没有说输入时要接二极管啊
我们目前暂时不看后面的cd4093,就说前面的电容和上拉部分(或者下拉部分),输入方波,输出Vi的波形我就看不明白,还请回答,谢谢 答 4: 那个二极管,并不是外加上去的,而本身就存在于CMOS的输入端上用来做ESD(静电放电)保护用的。几乎所有的CMOS逻辑器件都有这样的结构,请看下面的图片,这是一个CMOS的输入端等效图:
答 5:
保护电路看了数字电路的书,上面说这叫cmos的输入保护电路。
问题又来了,那就是上下尖峰脉冲都应该被钳位了,而不是只有正尖峰或者负尖峰被钳位了啊? 请圈圈大哥再次解答,谢谢了 答 6: 明白为什么很多手册标明输入电压范围VDD+0.3V/GND-0.3V了吗? 答 7: 是上下尖峰都被箝位了,你看图a的,是高端被箝位了,因为图a中接的是上拉,所以平时保持5V,被箝位后,正脉冲最多只有5.7V;而负脉冲则可以有-0.7V。
因此你看到图a中,那条水平线,就是5V,而上面的一点小尖尖,则是5.7V,而下面很长的尖尖,则是-0.7V。
同样的,图b你应该也会分析了吧?因为是下拉,所以水平线为0V,小尖尖为-0.7V,大尖尖为5.7V。
如图所示,为什么方波信号VIN经过电容后再上拉(或下拉)后,输出vin的上升沿和下降沿不一样? 答 1: 为什么我的图发不上去阿? 答 2: 因为输入端有二极管箝位。所以图1输入高电平时高不去;图2输入低电平时低不下。注意输入端的电流不能太大,否则可能会搞坏输入端的。 答 3: 没有二极管啊没有说输入时要接二极管啊
我们目前暂时不看后面的cd4093,就说前面的电容和上拉部分(或者下拉部分),输入方波,输出Vi的波形我就看不明白,还请回答,谢谢 答 4: 那个二极管,并不是外加上去的,而本身就存在于CMOS的输入端上用来做ESD(静电放电)保护用的。几乎所有的CMOS逻辑器件都有这样的结构,请看下面的图片,这是一个CMOS的输入端等效图:

问题又来了,那就是上下尖峰脉冲都应该被钳位了,而不是只有正尖峰或者负尖峰被钳位了啊? 请圈圈大哥再次解答,谢谢了 答 6: 明白为什么很多手册标明输入电压范围VDD+0.3V/GND-0.3V了吗? 答 7: 是上下尖峰都被箝位了,你看图a的,是高端被箝位了,因为图a中接的是上拉,所以平时保持5V,被箝位后,正脉冲最多只有5.7V;而负脉冲则可以有-0.7V。
因此你看到图a中,那条水平线,就是5V,而上面的一点小尖尖,则是5.7V,而下面很长的尖尖,则是-0.7V。
同样的,图b你应该也会分析了吧?因为是下拉,所以水平线为0V,小尖尖为-0.7V,大尖尖为5.7V。
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