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为什么我的移位寄存器的输出没有延时，和输入时序一样呢？而且复
[似水年华]
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ISE综合时把某个reg变量的位数给截掉了几位，怎么能让它不
[站的高尿的远]
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DDR2手册写着最大时钟800M，为啥配置成533.333不
[站的高尿的远]
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大圣们，这几个节点怎么理解呢
[jianwenchang]
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【Zynq】
求助FPGA V7 1440T编译工具
[watermelon631]
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vivado自带的终端的不能打印输出信息
[站的高尿的远]
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我想在板子上加一个RTC，除了在硬件上对IIC进行了配置，在
[jianwenchang]
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altium designer中的实点和虚点接点分别代表什么
[站的高尿的远]
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我现在从SD卡启动出现无法识别内核的格式的错误
[simonmao8385]
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启动的时候 挂起 怎么解决？
[simonmao8385]
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【Zynq】
ADS突然不能调试了。点击debug的时候，总是停留在这个页
[simonmao8385]
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【Zynq】
怎么查看自己的zedboard的芯片型号啊？
[simonmao8385]
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【Zynq】
报错问题，求大神帮忙解决
[少静]
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【Zynq】
为什么会有这样的错呢?
[阿飞]
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【ZedBoard开发手记】
ZYNQ平台OPENCV的移植(1)
[CMika]
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ise加XPS的方式设计遇到的问题
[站的高尿的远]
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【ZYNQ开发板申请】
开发板申请
[texell]
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【Zynq】
我在做boot.bin构建VIVADO工程，为什么这里不自动
[jianwenchang]
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XILINX有没有哪个文档是专门介绍PS与PL进行通讯时的接
[站的高尿的远]
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Xilinx改变世界的三十年
[wangyu]
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差分时钟接入FPGA的CC类型时钟管脚，我能把其用DCM处理
[站的高尿的远]
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【ZedBoard开发手记】
Zedboard I2C功能验证问题求助
[zwj1234]
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【Zynq】
获奖xilinx鼠标
[ming4129]
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结构体编译无问题，程序执行到结构体初始化的时候挂起了
[站的高尿的远]
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【Zynq】
ZedBoard学习手记（六）最后一步？通过上层应用程序调用
[啸风]
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AD输出的差分时钟接入ISE中的DCM作为全局时钟可行吗
[站的高尿的远]
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各位，我用zedboard的默认配置来配置7015 ,这样能
[站的高尿的远]
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【Zynq】
求助 怎样远程更新我的FPGA？
[longing05]
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【Zynq】
求助 通过PCAP接口怎么实现随时配置PL端
[longing05]
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