随着业界人士对CPLD、FPGA设计技术创新和应用需求的日益增长，Future与Altera公司将在北京举办专题研讨会，诚邀您参加。请通过电话或邮件预先报名，期待您的光临！
时间：2008年06月25日（星期三）下午13:15
地点：清华大学电工电子实验教学中心CAD实验室（西主楼4区209室）
乘车路线：城铁13号线五道口站或乘车，至清华大学东门（向南开），入门向北直走至主楼西侧即到西主楼
联系人：
冯静（Karin Feng） +86-10-6418 2335-221
Karin.Feng@FutureElectronics.com
齐闯 (Brand Qi) +86-139-1155-6862
Brand.Qi@FutureElectronics.com
日程安排：
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时间 |
主题 |
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13:15 – 13:30 |
签到 |
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13:30 – 14:30 |
Cyclone® III FPGA 板级设计应用指导 |
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14:30 – 15:00 |
Arria™ GX FPGA 无风险连接高速串行器件应用分析 |
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15:00 – 15:15 |
茶歇 |
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15:15 – 16:05 |
TimeQuest 时序分析基础：基于SDC的FPGA时序分析 |
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16:05 – 17:30 |
使用 SignalTap® II 嵌入式逻辑分析器进行设计调试 |
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17:30 – 17:35 |
总结 |
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物联网技术
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板卡试用
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