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完美时序(强烈推荐)

高工
2009-07-04 12:27:18     打赏

完美时序
时钟产生和分发设计指南

中文PDF,120页,由CYPRESS工程师编写,写得很好,强烈推荐!!!!

完美时序.rar

简介:
在您设计时钟电路时是否仅仅因为某些方法在过去一直沿用,所以就采用它呢?或者您曾经使用过某个器件仅仅是因为其他设计中使用了它?这种现象在如今的设计中经常出现,特别是在时钟发生和分发电路中。
本书是由工程师们编写的,目标读者是那些希望用最好的方法设计时钟电路的工程师。它重点讲述高速数字设计中时钟发生和分发电路的实施。本书材料是从许多经过时间检验的设计方案中挑选出来的,同时还对可满足更快的时钟频率需要的新技术进行了介绍。
最终目标是获得纯净、稳定的时钟。现在,许多公司投入整个部门来专门研究信号集成,他们进行仿真、设计审查以及各种分析,以确保时钟的最佳运行状态。设计者应考虑到几个影响时钟波形的因素,本书将研讨时钟设计的若干关键问题。
时钟发生器在当今的设计中起着举足轻重的作用,在对高速度的追求中,很多系统采用了同步设计方式,随着此方法的应用,对相同时钟产生各种频率以及产生许多副本的需要也随之产生。在大多数系统中,这些时钟需要彼此同相,否则,则将损失宝贵的周期时间。在保持所有器件以其峰值速率工作时,时钟之间的偏斜变得非常重要。专用的时钟缓冲器在提供纯净、精确的时钟信号方面起着主导作用。
锁相环的使用还最大程度地减小了时钟之间的延时。这些器件为设计者提供了更多的灵活性,使设计者可以对齐时钟边沿,或者使时钟前移或后移,从而增大数据有效窗口。它们还可以补偿线路长度延时和独特的芯片时序,时钟缓冲器的确可以帮助工程师设计出最佳电路。
第2章讨论具有低偏斜输出和零延时缓冲器的时钟驱动器。该章讨论它们的工作原理并重点介绍某些典型应用。这两种器件是时钟分发的基础,专为生成具有纯净、对称边沿的时钟信号而设计。
在同步系统中,时序预算是成功满足设定时间和保持时间的关键。第3章讨论计算时序宽裕度时需考虑的许多因素。抖动、偏斜、相位误差以及许多其他可变因素可能在指定周期中占用宝贵的时间。但是这些因素如何合并在一起相互影响呢?该章讨论分析不同因素所需方法,还介绍了一种称为总时序预算的新方法,此值帮助设计者确定周期时间的影响因素,同时不使其宽裕度过大。
抖动是时钟设计中常用的术语,但是,它有很多被误解的定义。第4章讨论抖动的起因和定义,并揭开与数据手册标签相关的神秘面纱。对各种类型的抖动进行了讨论,并介绍如何进行测量。这使设计者可以评估对设计真正有影响的各类抖动。还着重介绍了抖动的特性,以有助于隔离可能造成过度抖动的信号源。
有很多因素可影响时钟的性能,其中有一种是渗入电源系统中的噪声。噪声会增加时钟缓冲器和锁相环的抖动和延时。第5章讨论噪声的影响以及如何将噪声影响减到最小。使用旁路电容器和磁珠可获得纯净、稳定的电源。该章介绍了各种时钟系统测试的结果。
在向时钟元件提供纯净稳定的电源时,同样至关重要的是电源层的布线。第6章讨论提供稳定的电源性能的印刷电路板设计方法。从层到切口,从过孔到旁路电容器接线,该章详细介绍了须遵循的规则。该章还介绍了单个时钟信号的布线规则。为了提供无误差的波形,介绍了各种信号布线考虑因素。串扰、阻抗不均衡、过孔和线宽对信号完整性均有重要的影响,在设计时钟电路时须加以考虑。
随着数字时钟的速度增快,它们成为传输线。可能会出现各种发射,如果未加端接,可能导致误触发。第7章讨论时钟信号线路端接的各个方面。有多种方法可以端接信号,因此,将讨论各种方法。因为如今高速世界流行差分信号,将讨论LVPECL和LVDS两种差分信号端接。
当采用时钟缓冲器和锁相环时,工程师经常问“可以串联多少个锁相环?”第8章将回答此问题。该章详细介绍锁相环的本质及其回路带宽,这是理解此问题答案的关键所在。
电磁干扰(EMI)是公众所用设备中的一个非常重要的因素。很多系统必须在产品投放市场前通过严格的测试标准,设计者通常面临在就要完成整个设计之前需要解决电磁干扰的问题,但是多数情况下并不是很清楚什么原因造成电磁干扰,更糟糕的是不知道如何处理。第9章讨论电磁干扰来自何处以及如何测量。在确定电磁干扰的影响时,理解时钟信号有某些独特的属性(如谐波)相当重要。该章解释这些关系并讨论各种抑制这些不希望的信号的方法。
在提交一份设计图进行生产之前,建议仿真时钟信号以确保该电路可100%正确工作。当前为获得信号完整性所使用的流行工具是IBIS和SPICE模型仿真程序。第10章介绍这些模型以及其中包含的有关时钟元件的信息。这使工程师可以了解仿真的真正意义。
设计结束后并且电路板在测试中时,工程师如何验证时钟信号能否正确工作呢?可使用任何探针或示波器吗?第11章讨论采用不适当的设备探测高速数字时钟时的常见缺陷。该章还介绍可用于测量实际时钟信号的方法。
第12章讨论时钟发生器。时钟发生器是零延时缓冲器的扩展,但具有其它的特性与优点。它可以生成似乎无关的频率,满足当前同步系统中很多时钟的需要。该章讨论这些器件如何工作,以及某些关键属性,这些属性使时钟发生器必不可少。




关键词: 完美     时序     强烈     推荐     时钟     设计     信号     讨论    

助工
2009-07-06 10:51:13     打赏
2楼
不错,正在找这方面的资料,感觉时序是自己一直都不太清楚的地方

菜鸟
2020-06-14 22:20:31     打赏
3楼

看看,学习,谢谢


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