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电子产品世界 » 论坛首页 » DIY与开源设计 » 电子DIY » 自己参与DIY cpld

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自己参与DIY cpld

love0614
菜鸟
2013-05-20 18:01:52     打赏
我选择第二（一）种方案：申请PCB板，购买组委会提供的元器件包
实验名称：基于CPLD的24秒倒计时


实验概要：完成功能：通过数码管显示24秒的计时状态，当到计时到00时蜂鸣器响，按键有一个暂停。后续完善


关注这个CPLD的DIY很久了，以前学过的51，STM32等都是C语言编程，虽说有一定的编程基础，但Verilog HDL是初次接触，想通过贵网站的DIY活动实现这个实验，能熟练掌握CPLD对各种外设、总线的操作。自己的方向是高速数据采集，也想为以后的FPGA 学习打下基础。希望我能从这次活动中有所收获。

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关键词： 自己     参与    

jackwang
院士
2013-05-20 20:54:16     打赏
2楼

这里有写的~~~，还是改改吧，想用这开发板干点啥

学号99

 

 


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love0614
菜鸟
2013-05-24 12:56:25     打赏
3楼
玩彩屏，玩点阵呀，全彩点阵，fpga处理的更快

评论
nakey
高工
2013-06-03 11:31:03     打赏
4楼
您好，恭喜您的初审已经通过

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