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电子产品世界 » 论坛首页 » 嵌入式开发 » FPGA » 给您聊聊XST​和Synplify Pro综合结果的区别.

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内马尔
菜鸟
2013-08-19 08:34:09     打赏
11楼
解决方法 
解决上面的问题很简单，只需根据设计意图将“IDLE”、“PREAMBLE”、“SFD”等状态的转移条件进
行改写，将不完整的“if”条件语句改为“if...else”条件语句即可。
作者提供的源代码在经过修改“竞争冒险”和“锁存器”两类问题后，XST和Synplify的综合结果的仿真波
形完全一致，都符合了设计意图。

评论
asdf1143
菜鸟
2013-08-19 16:59:50     打赏
12楼
好详细

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卢西奥
菜鸟
2013-08-20 22:29:15     打赏
13楼
通过前面的分析，我们发现造成XST与Synplify的综合结果不一致的原因在于作者错误使用了锁存器结构。
为了加强读者对“代码风格”、“综合后仿真”、RTL视图等概念的理解，在此引申谈一下上述问题。

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祝家庄
助工
2013-08-22 08:25:31     打赏
14楼
1. 综合后仿真的概念与作用 
综合后仿真的最主要作用在于验证综合器的综合结果是否与设计意图一致。仿真时，把综合生成的延时文
件反标到综合仿真文件中去，可估计逻辑门延时带来的影响。该仿真只能估计门延时，而不能估计线延
时，仿真结果与布线后的实际情况还有一定的差距，并不十分准确。有些设计工程师认为综合器是永远可
靠的，综合出的电路应该与设计意图一致，综合后仿真与功能仿真结果一致。这种观点是错误的，只要当
代码风格合理，不出现让综合器误解的描述时，综合结果才会和设计意图完全一致。在一般情况下建议不
要省略此步骤。

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小江湖
助工
2013-08-23 07:18:16     打赏
15楼
2. 代码设计风格对设计的影响 
在学习逻辑设计之初，老师总是强调代码风格的重要性。有些设计工程师认为现在综合器的优化功能越来
越强，对大部分设计都可以优化。这种观点是不对的，综合器的优化结果主要是依靠设计工程师的代码风
格。设计风格对综合结果的影响可以用一句话概括：“好的代码设计风格会使综合器事半功倍，达到最优
的综合结果；不好的代码设计风格会使综合器南辕北辙，产生错误的综合结果。”本文的实例的所有问题
都源于其代码风格不尽合理，而并不在于综合器。

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内马尔
菜鸟
2013-08-26 09:26:37     打赏
16楼
3. 状态机设计方法。 
状态机的设计方法很多，描述方法不一而同，目前如StateCAD等状态机辅助设计软件给用户提供了很多的
帮助。这里需要强调的是在状态机的设计中使用条件判断语句一定要慎重，尽量使用“if...else”这种完整
的判断结构。有时判断语句使用不合理，会造成综合器对设计的误解，不同的综合器的默认综合结果会因
为是否使用了锁存器，是否使用了带有优先级的编译码器等结构而不同。

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红米
菜鸟
2013-08-27 08:12:18     打赏
17楼
4. 一些有用的辅助分析工具。 
FPGA/CPLD等可编程逻辑器件的长足发展在一定程度上就是因为其EDA辅助设计工具的智能化、易学易
用、功能强大等优势。在本例分析综合结果的过程中，并未直接分析综合器的输出网表，而是使用了RTL视
图进行分析，直观、快捷，提高了分析效率。

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小江湖
助工
2013-08-28 08:15:03     打赏
18楼
猴哥在这里发威了，绝对支持。

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菜鸟求教
助工
2013-08-29 07:07:55     打赏
19楼
谢谢啦。

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lulu08171537
助工
2015-12-17 18:27:21     打赏
20楼
求大神给个synplify pro 软件链接,不胜感激

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