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赛灵思自曝八大秘笈(7)：在Zynq上用MIG扩展内存(2)-Vivado篇 【FPGA/CPLD】
wangying|浏览：3207|回复：5| anytao 2017-03-24 20:03:05
64位modelsim以及questasim破解无法生成LICENSEN.TXT文档问题解决方式 【FPGA/CPLD】
theskyofsnail|浏览：7055|回复：2| 熊猫爱善 2017-03-16 10:28:09
FPGA用户IO口采集信号求助 【FPGA/CPLD】
XJTUMile|浏览：3424|回复：1| yazixiaowo 2017-01-08 14:20:45
视频详解：上海尤老师verilog入门到实战第十五课 【FPGA/CPLD】
l51031767|浏览：3022|回复：4| 凤凰息梧桐 2016-12-31 08:22:29
关于用28335编程读取某个支持modbus协议模块内部寄存器的问题，用的是04功能 【DSP系统】
永恒星之眼|浏览：4197|回复：0| 永恒星之眼 2016-11-17 08:53:14
视频详解：上海尤老师verilog入门到实战第三课 【FPGA/CPLD】
l51031767|浏览：1966|回复：2| 南盗 2016-10-28 19:39:10
视频详解：上海尤老师verilog入门到实战第十四课 【FPGA/CPLD】
l51031767|浏览：2294|回复：2| 雷达信号处理 2016-10-23 10:28:32
视频详解：上海尤老师verilog入门到实战第二课 【FPGA/CPLD】
l51031767|浏览：1897|回复：2| vaioshop 2016-10-09 08:13:32
视频详解：上海尤老师verilog学习入门到实战第一课 【FPGA/CPLD】
l51031767|浏览：2136|回复：2| vaioshop 2016-10-09 08:13:15
视频详解：上海尤老师verilog入门到实战第十三课 【FPGA/CPLD】
l51031767|浏览：2829|回复：2| hua_wind 2016-10-09 08:11:56
视频详解：上海尤老师verilog入门到实战第四课 【FPGA/CPLD】
l51031767|浏览：1737|回复：1| 雷达信号处理 2016-10-08 21:27:23
视频详解：上海尤老师verilog入门到实战第五课 【FPGA/CPLD】
l51031767|浏览：1847|回复：1| 雷达信号处理 2016-10-08 21:26:39
视频详解：上海尤老师verilog入门到实战第六课 【FPGA/CPLD】
l51031767|浏览：1714|回复：2| 雷达信号处理 2016-10-08 21:26:09
视频详解：上海尤老师verilog入门到实战第七课 【FPGA/CPLD】
l51031767|浏览：2079|回复：1| 雷达信号处理 2016-10-08 21:18:19
视频详解：上海尤老师verilog入门到实战第八课 【FPGA/CPLD】
l51031767|浏览：1876|回复：1| 雷达信号处理 2016-10-08 21:17:06
视频详解：上海尤老师verilog入门到实战第九课 【FPGA/CPLD】
l51031767|浏览：1871|回复：1| 雷达信号处理 2016-10-08 21:16:26
视频详解：上海尤老师verilog入门到实战第十课 【FPGA/CPLD】
l51031767|浏览：2040|回复：1| 雷达信号处理 2016-10-08 21:15:49
视频详解：上海尤老师verilog入门到实战第十一课 【FPGA/CPLD】
l51031767|浏览：2293|回复：1| 雷达信号处理 2016-10-08 21:15:00
视频详解：上海尤老师verilog入门到实战第十二课 【FPGA/CPLD】
l51031767|浏览：2185|回复：5| 雷达信号处理 2016-10-08 21:14:35
XMOS USB Audio多声道方案和应用 【DSP系统】
qiusongxiao|浏览：8032|回复：0| qiusongxiao 2016-09-19 10:20:10
real-time mode出错，请教高手！ 【DSP系统】
dsz198633|浏览：1670|回复：0| dsz198633 2016-09-13 21:24:47
altera Cyclone v系列的封装库 【FPGA/CPLD】
october3|浏览：1528|回复：0| october3 2016-08-18 18:58:15
DSP/BIOS 【DSP系统】
dianzi88|浏览：1709|回复：1| linmin418 2016-04-23 16:35:02
再请教一下，MIG的约束文件中IDELAYCTRL Location Constraints 怎么改呢 【FPGA/CPLD】
xie0jing0|浏览：12222|回复：8| z894811350 2016-03-16 16:40:14
用什么Verilog 编程软件好呢 【FPGA/CPLD】
xie0jing0|浏览：18667|回复：16| yxliu 2016-02-18 16:51:48
PhysDesignRules ERROR 【FPGA/CPLD】
zcgeek|浏览：2656|回复：2| zcgeek 2016-01-26 17:32:03
有人用ALTERA的MAX10芯片做NIOS系统吗？固化进去之后程序在乱跑 【FPGA/CPLD】
星际水手|浏览：2516|回复：0| 星际水手 2016-01-19 16:17:09
nios13.0创建了一个ucos 的工程，但是ucos没能工作，不执行相应的任务 【FPGA/CPLD】
站的高尿的远|浏览：1859|回复：2| taksonwelson 2016-01-14 10:56:51
Cyclone II PLL问题 【FPGA/CPLD】
阿苍|浏览：3240|回复：4| taksonwelson 2016-01-14 10:53:13
求FPGA控制直流电机的代码？Verilog编写的，用按键控制其速度，转向，启停 【FPGA/CPLD】
心染红尘|浏览：2520|回复：3| taksonwelson 2016-01-14 10:41:50
用FPGA驱动豪威（ov）5620之寄存器初始化问题 【FPGA/CPLD】
阿PFGA|浏览：3067|回复：7| taksonwelson 2016-01-14 10:40:43
哪如果要时序仿真得自己另外下载modesim做么？ 【FPGA/CPLD】
站的高尿的远|浏览：1780|回复：2| taksonwelson 2016-01-14 10:39:33
MODELSIM仿真提示already declared in this scope 【FPGA/CPLD】
duxvfeng|浏览：4929|回复：3| taksonwelson 2016-01-14 10:35:46
求助如何理解这句SyncClk 【FPGA/CPLD】
暗夜涌袭|浏览：2340|回复：2| tokeyman 2015-12-17 22:44:30
用synplify综合Xilinx的core后为什么在Technology view中看不到相应的模块？ 【FPGA/CPLD】
becoll|浏览：9559|回复：4| lulu08171537 2015-12-17 18:26:03
完整数字频率计verilog代码 【FPGA/CPLD】
Jason_Zhang|浏览：6993|回复：8| 花涛 2015-12-15 08:38:19
新人求助，关于vivado的使用 【FPGA/CPLD】
羽蛇神|浏览：4346|回复：1| machinnneee 2015-12-12 11:10:02
【TMS320C6748开发板试用体验】LED和OLED 【DSP系统】
Tan654321|浏览：1685|回复：0| Tan654321 2015-11-05 10:21:47
CORDIC计算三角函数（附verilog代码） 【FPGA/CPLD】
Jason_Zhang|浏览：15114|回复：19| bgnbgn 2015-11-01 07:48:45
ise 调用 modelsim error loading design 测试testbench 【FPGA/CPLD】
火焰昌|浏览：2772|回复：0| 火焰昌 2015-09-29 11:15:52
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