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Verilog实现按键消抖检测教程 【FPGA/CPLD】
dasdzxc|浏览：1387|回复：0| dasdzxc 2017-06-29 14:12:03
Verilog教程—— specify功能 【FPGA/CPLD】
WZH702461|浏览：2527|回复：0| WZH702461 2017-06-29 13:58:45
Xilinx SelectIO资源的使用总结 【FPGA/CPLD】
mhx3211|浏览：1840|回复：0| mhx3211 2017-06-29 13:52:11
求大神解答一下unexpected token的问题 【FPGA/CPLD】
zxcxzcvaczv|浏览：1369|回复：0| zxcxzcvaczv 2017-06-29 13:40:29
ZYNQ学习笔记（一） HelloWorld实现 【FPGA/CPLD】
hedibn012|浏览：1345|回复：0| hedibn012 2017-06-29 13:31:55
Zynq基础4：yocto 【FPGA/CPLD】
wylbj|浏览：1280|回复：0| wylbj 2017-06-28 16:41:59
Verilog基础知识0 【FPGA/CPLD】
wllaodage|浏览：1186|回复：0| wllaodage 2017-06-28 16:28:30
SDSoC使用体验 【FPGA/CPLD】
Timine|浏览：1623|回复：0| Timine 2017-06-28 16:21:10
Vivado Hls 设计流程总结 【FPGA/CPLD】
L周O逗V逗E|浏览：1357|回复：0| L周O逗V逗E 2017-06-28 16:15:31
在Vivado Hls中，数据类型的转化分析 【FPGA/CPLD】
L周O逗V逗E|浏览：2192|回复：0| L周O逗V逗E 2017-06-28 16:14:25
在Vivado Hls中，数据类型的转化分析 【FPGA/CPLD】
L周O逗V逗E|浏览：1415|回复：0| L周O逗V逗E 2017-06-28 16:09:17
何为锁存器的time borrowing？ 【FPGA/CPLD】
南城旧梦lgl|浏览：1470|回复：0| 南城旧梦lgl 2017-06-28 16:01:38
xilinx CLB资源详解--slice、分布式RAM和Block ram 【FPGA/CPLD】
hedibn012|浏览：1641|回复：0| hedibn012 2017-06-28 15:48:35
详解python的几种标准输出重定向方式 【FPGA/CPLD】
WZH702461|浏览：1171|回复：0| WZH702461 2017-06-28 15:09:37
关于如何实现在Xilink ZYNQ上将FPGA的IO等资源配置到ARM上 【FPGA/CPLD】
mhx3211|浏览：1647|回复：0| mhx3211 2017-06-28 15:06:06
vivado中TCL的使用 【FPGA/CPLD】
hedibn012|浏览：1347|回复：0| hedibn012 2017-06-28 15:04:13
时钟频率对程序效率影响测试(Platform: ARM ZYNQ 7000 ZP20 Board) 【FPGA/CPLD】
hedibn012|浏览：1223|回复：0| hedibn012 2017-06-28 14:54:39
基于ZYNQ7000交叉编译工具链Qt+OpenCV+ffmpeg等库支持总结(上) 【FPGA/CPLD】
hongweidt102|浏览：1735|回复：0| hongweidt102 2017-06-28 14:45:49
Zynq高速串行CMOS接口设计与实现 【FPGA/CPLD】
hongweidt102|浏览：3313|回复：0| hongweidt102 2017-06-28 14:41:39
QT+OpenCV的边缘检测测试 【FPGA/CPLD】
hongweidt102|浏览：1674|回复：0| hongweidt102 2017-06-28 14:25:43
Xilinx的socket CAN驱动介绍 【FPGA/CPLD】
hongweidt102|浏览：1529|回复：0| hongweidt102 2017-06-28 13:42:12
Verilog的testbench入门 【FPGA/CPLD】
littleshrlmp|浏览：1665|回复：0| littleshrlmp 2017-06-27 16:56:47
FPGA的引脚VCCINT 、VCCIO VCCA 【FPGA/CPLD】
span14|浏览：1747|回复：0| span14 2017-06-27 15:30:01
用VHDL/VerilogHD语言开发PLD/FPGA的完整流程VHDL实例 【FPGA/CPLD】
wllaodage|浏览：1460|回复：0| wllaodage 2017-06-27 15:10:25
Choosing FPGA or DSP for your Application 【FPGA/CPLD】
cqa29|浏览：1212|回复：0| cqa29 2017-06-27 14:58:33
FPGAs: the high-end alternative for DSP application 【FPGA/CPLD】
cqa29|浏览：1049|回复：0| cqa29 2017-06-27 14:57:07
MicroBlaze在电机和运动控制方面的设想 【FPGA/CPLD】
南城旧梦lgl|浏览：1269|回复：0| 南城旧梦lgl 2017-06-27 14:45:26
Vivado中各个文件的含义 【FPGA/CPLD】
littleshrlmp|浏览：1628|回复：0| littleshrlmp 2017-06-27 14:04:44
使用fmccoms4-ez来做延迟信号处理 【FPGA/CPLD】
span14|浏览：1008|回复：0| span14 2017-06-27 13:40:58
小白问verilog程序应该怎么写好呢？ 【FPGA/CPLD】
dasdzxc|浏览：1306|回复：1| 孑然儿 2017-06-26 16:46:57
quartus2和modelsim—altera仿真rom ip 【FPGA/CPLD】
xueshawu1|浏览：1942|回复：0| xueshawu1 2017-06-26 16:40:45
quartus II 13.1 nco核仿真报错，error loading design，显示do文件执行到41行是停止 【FPGA/CPLD】
mhx3211|浏览：3256|回复：0| mhx3211 2017-06-26 16:27:01
Go语言与GPIO: 2 按键处理 【FPGA/CPLD】
littleshrlmp|浏览：1426|回复：0| littleshrlmp 2017-06-26 16:24:33
使用fmccoms4-ez来做延迟信号处理 【FPGA/CPLD】
浮沉1988|浏览：958|回复：0| 浮沉1988 2017-06-26 16:06:03
Verilog典型电路设计 【FPGA/CPLD】
zhrscut|浏览：30958|回复：163| workingdu 2017-05-16 15:30:56
FPGA开发讲座2:掌握Verilog的设计利器（ppt） 【FPGA/CPLD】
卢西奥|浏览：11125|回复：51| FPGAwuhan 2017-04-22 14:44:57
从系统的小型化和可重构性角度出发介绍了SOPC技术,给出了单芯片数字接收机的实现方案,利用系统工具DSPBuilder给出了QPSK解调功能模块的实现 【FPGA/CPLD】
wangying|浏览：3153|回复：3| 等等到到 2017-03-27 21:41:42
基于至简设计法实现的PWM调制verilog 【FPGA/CPLD】
PKJIE吴|浏览：3190|回复：1| PKJIE吴 2017-03-25 15:23:31
图片在FPGA中的ROM的存储？ 【FPGA/CPLD】
小菜110|浏览：6933|回复：14| anytao 2017-03-24 20:12:21
system generator 信号处理 【FPGA/CPLD】
wby1331|浏览：2244|回复：2| anytao 2017-03-24 20:10:55
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