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DSP系统设计100问之.时钟电路选择原则 【DSP系统】
zhuzai|浏览：1269|回复：0| zhuzai 2014-08-22 13:07:06
实时操作系统DSP/BIOS在DSP开发中的应用 【DSP系统】
yangyun|浏览：1177|回复：0| yangyun 2014-08-20 19:48:39
我看FPGA现在难以取代FPGA+DSP的架构，这段时间的思索总结 【DSP系统】
yangyun|浏览：1026|回复：0| yangyun 2014-08-20 13:44:04
单片机控制技术用于空调器通电延时启动保护器 【DSP系统】
yangyun|浏览：1068|回复：0| yangyun 2014-08-20 13:32:47
关于DSP芯片如何选择外部时钟 【DSP系统】
zhuzai|浏览：1112|回复：0| zhuzai 2014-08-15 14:00:08
2812片内ADC采样时间计算 【DSP系统】
zhuzai|浏览：1011|回复：0| zhuzai 2014-08-15 13:53:57
用软件定时的计算方法 【DSP系统】
zhuzai|浏览：986|回复：0| zhuzai 2014-08-15 13:38:27
5509A扩展外部存储器SDRAM时对GPIO0引脚的设置 【DSP系统】
zhuzai|浏览：1635|回复：0| zhuzai 2014-08-15 13:35:31
28335编译时解决WARNING_invalid_compiler_option_--float_support=fpu32 【DSP系统】
九哥|浏览：3775|回复：2| HUSTLRH 2014-08-04 20:41:02
在quartus9.0改动程序编译成功后为何不能时实的下载到板子里？ 【FPGA/CPLD】
QXM123|浏览：2918|回复：0| QXM123 2014-08-02 14:49:44
用FPGA替代DSP实现实时视频处理 【FPGA/CPLD】
xiaogun|浏览：2131|回复：1| htbadboy 2014-07-31 10:12:06
FPGA与CPLD的区别 【FPGA/CPLD】
xiaogun|浏览：2309|回复：0| xiaogun 2014-07-30 21:47:04
降低FPGA功耗的设计技巧 【FPGA/CPLD】
xiaogun|浏览：1513|回复：0| xiaogun 2014-07-30 21:02:55
问一下，我配置nios软核的时候出现这个错误，怎么搞？ 【FPGA/CPLD】
站的高尿的远|浏览：1743|回复：1| halibote523 2014-07-24 22:02:51
ccs 3.3 如何使用realtime mode 使变量能够实时更新 【DSP系统】
zhongshengufo|浏览：4354|回复：1| paradoxfx 2014-07-20 12:57:53
请教一个关于检测回波时间的问题，怎么能让一个上升沿来了之后计数器停止计数。 【FPGA/CPLD】
fangyu12|浏览：2780|回复：4| htbadboy 2014-07-07 17:09:25
手工焊接BGA封装，在PCB设计时，BGA引脚旁的过孔的内径、外径一般为多少mil/mm? 【FPGA/CPLD】
站的高尿的远|浏览：2653|回复：0| 站的高尿的远 2014-06-30 16:29:30
问个问题，大家在做FPGA开发的时候，功能仿真是必须的么？ 【FPGA/CPLD】
站的高尿的远|浏览：1818|回复：1| 51FPGA 2014-06-03 14:45:20
新人求助，请问如何完成下面的时序 【FPGA/CPLD】
fangyu12|浏览：2400|回复：4| fangyu12 2014-05-27 19:01:43
我在PlanAhead中绘制Pblock的时候为什么出现一些粗的线，这些线是什么意思？ 【FPGA/CPLD】
阿苍|浏览：2844|回复：2| 阿苍 2014-05-23 08:53:10
求助：用ISE自带的Isim仿真时提示fatal error 【FPGA/CPLD】
zl19891025|浏览：5202|回复：1| li308922492 2014-05-22 14:11:36
求问关于CCS4 使用时配置的问题~~~ 【DSP系统】
利刃侠|浏览：3908|回复：7| jackwang 2014-05-21 09:11:59
请教一个EPWM 时钟问题 【DSP系统】
zhoumeng4077|浏览：37|回复：5| Snake0301 2014-05-17 18:32:02
关于用modelsim做时序仿真的问题 【FPGA/CPLD】
zyo0|浏览：3235|回复：8| zyo0 2014-05-09 00:54:49
mcu模拟jtag时序配置fpga问题 【FPGA/CPLD】
kanojoy|浏览：2609|回复：5| 573181735 2014-04-08 23:08:47
自定IP核的，协议选为AXI的这种IP核时，user logic里面用得怎么样啊 【FPGA/CPLD】
roger|浏览：1446|回复：0| roger 2014-03-13 13:26:53
FPGA顶模块调用的子模块比较多时，是在XPS里生成顶模块IP么？可以在planahead里将我的FPGA代码放在system_slut.v下面作为它的子模块么 【FPGA/CPLD】
simonmao8385|浏览：3349|回复：5| 可爱女孩89 2014-03-12 16:52:43
时钟问题 【FPGA/CPLD】
yk01099038|浏览：3817|回复：0| yk01099038 2014-02-27 10:43:55
调用Altera的IP库，未经授权时可使用多久啊？ 【FPGA/CPLD】
myxxyy|浏览：6040|回复：7| 华帆科技 2014-02-08 11:39:15
XILINX SERDES SI仿真时发送侧抖动的设置 【FPGA/CPLD】
wangying|浏览：2528|回复：1| friends 2014-01-07 22:38:05
咨询下Altera FPGA全局时钟资源问题 【FPGA/CPLD】
卢西奥|浏览：2997|回复：1| 小江湖 2013-12-02 17:36:50
请教TMS320f28xx芯片量产时，怎么在板写入程序？ 【DSP系统】
九哥|浏览：50503|回复：21| 内马尔 2013-10-08 07:17:42
循环结构的延时计算，怎么算延时了多长啊！ 【DSP系统】
红米|浏览：8561|回复：31| 内马尔 2013-10-08 07:16:18
DSP定时器问题 【DSP系统】
fighting1|浏览：2173|回复：3| paradoxfx 2013-09-25 20:14:35
FPGA程序设计的时候应该把握什么准则或者是思想 【FPGA/CPLD】
liklon|浏览：2600|回复：3| hxing 2013-09-14 23:18:27
FPGA输出信号的时延问题 【FPGA/CPLD】
linuxp|浏览：2721|回复：4| friends 2013-09-09 21:55:21
FPGA和ASSP重压之下的ASIC 时日不多了吗？ 【FPGA/CPLD】
小江湖|浏览：4568|回复：15| Snake0301 2013-08-05 17:16:03
今天趁下班时间把板子焊好了，明天测试一下，蜂鸣器封装有点儿不太好感觉 【FPGA/CPLD】
liujinlu866|浏览：4554|回复：13| 啸风 2013-07-29 20:37:03
【转】数字信号处理 教案 ---- 2、时域离散信号和系统的频域分析 【DSP系统】
菜鸟求教|浏览：2150|回复：2| machinnneee 2013-07-15 14:53:31
[VHDL] 初始化dm9000a时遇到的问题 【FPGA/CPLD】
syliconix|浏览：5810|回复：1| FPGALOL 2013-06-19 13:56:24
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