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FPGA顶模块调用的子模块比较多时，是在XPS里生成顶模块IP么？可以在planahead里将我的FPGA代码放在system_slut.v下面作为它的子模块么

simonmao8385
高工
2014-02-17 10:48:24     打赏
麻烦问大家一个问题，FPGA顶模块调用的子模块比较多时，是在XPS里生成顶模块IP么？可以在planahead里将我的FPGA代码放在system_slut.v下面作为它的子模块么？？？麻烦大家了。不清楚FPGA代码在里面怎么开发，求大神指点！
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关键词： Xilinz     FPGA    

jackwang
院士
2014-02-17 11:25:33     打赏
2楼
这个还需要51FPGA大神儿给看看

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lianggui5
工程师
2014-02-17 12:47:58     打赏
3楼
FPGA模块较多，每个模块都是单独的文件，放到一个工程里面，然后在对应的顶层模块中，写上对应的模块，连好线就可以了。

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friends
高工
2014-02-21 22:48:37     打赏
4楼
代码一般都是在子模块中开发，顶层模块负责关联各个子模块的接口

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Snake0301
高工
2014-02-27 17:43:45     打赏
5楼

我喜欢把代码生成原理图

最顶层的系统，全部用原理图去连接。


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可爱女孩89
菜鸟
2014-03-12 16:52:43     打赏
6楼
有人会编写FFT IP核代码吗？急求

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